[发明专利]一种基于DSP-FPGA的大规模并行数据采样控制时序的方法有效
| 申请号： | 201711073244.2 | 申请日： | 2017-11-04 |
| 公开（公告）号： | CN108008668B | 公开（公告）日： | 2020-10-20 |
| 发明（设计）人： | 范瑞祥;徐宁;辛建波;王文彬;蒙天琪;李琼 | 申请（专利权）人： | 国网江西省电力公司电力科学研究院;国家电网公司 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042 |
| 代理公司： | 南昌市平凡知识产权代理事务所 36122 | 代理人： | 姚伯川 |
| 地址： | 330096 江西*** | 国省代码： | 江西;36 |
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| 摘要： | 一种基于DSP‑FPGA的大规模并行数据采样控制时序的方法，所述方法由DSP控制系统和直流采样系统通过DSP‑FPGA采样板实行并行数据采样。DSP控制系统通过采集三相系统电压、三相输出电流、三相负载电流以及参考电压，以光纤信号形式从主电路传输至系统采样板；经转换后通过母板传输给DSP‑FPGA采样板；直流采样系统通过链式结构的采样压频转换板将电压信号转换成频率信号，并通过光纤通讯方式将处理后的频率信号传输给DSP‑FPGA采样板。本发明大规模并行数据采样控制时序可以大大提高并行数据采集传输速度和容量；采用DSP‑FPGA采样控制时序可以使大规模并行数据采样控制技术在传输速度、容量和安全性方面有很大提升。 | ||
| 搜索关键词： | 一种 基于 dsp fpga 大规模 并行 数据 采样 控制 时序 方法 | ||
【主权项】：
1.一种基于DSP-FPGA的大规模并行数据采样控制时序的方法，其特征在于，所述方法由DSP控制系统和直流采样系统通过DSP-FPGA采样板实行并行数据采样，DSP控制系统通过采集三相系统电压、三相输出电流、三相负载电流以及参考电压，以光纤信号形式从主电路传输至系统采样板，经转换后通过母板传输给DSP-FPGA采样板；直流采样系统通过链式结构的采样压频转换板将电压信号转换成频率信号，并通过光纤通讯方式将处理后的频率信号传输给DSP-FPGA采样板；所述DSP-FPGA采样板采样控制时序如下：(1)DSP芯片发出CS2和CS1为01的片选信号，选中采样FPGA；(2)FPGA发出Ready2和Ready1为01的准备信号给DSP芯片，表示FPGA空闲，可进行数据采样；DSP芯片CSFlag置1；(3)FPGA读取并上传每个CLK_100us时钟周期的系统电压压频信号脉冲数、每个Clk_20ms时钟周期的直流电压压频信号脉冲数给DSP芯片，并在每个DSP_CLK时钟上升沿时，DSP芯片读取FPGA上传的数据；(4)按步骤(3)，FPGA继续将36路直流电压，负载电流，输出电流，参考电压发送至DSP芯片；(5)DSP芯片将CS2CS1置11，取消片选信号；(6)FPGA将Ready2和Ready1置11，进入忙状态；(7)采样结束。
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