[发明专利]功率半导体器件及其制造方法在审
申请号: | 201711146653.0 | 申请日: | 2017-11-17 |
公开(公告)号: | CN107910266A | 公开(公告)日: | 2018-04-13 |
发明(设计)人: | 杨彦涛;夏志平;王维建 | 申请(专利权)人: | 杭州士兰集成电路有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/78;H01L29/06 |
代理公司: | 北京成创同维知识产权代理有限公司11449 | 代理人: | 蔡纯,张靖琳 |
地址: | 310018 浙江省杭州市杭*** | 国省代码: | 浙江;33 |
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摘要: | 本申请公开了功率半导体器件及其制造方法。该方法包括在多个沟槽的侧壁和底部上形成绝缘叠层,所述绝缘叠层包括第一绝缘层和第二绝缘层,所述第一绝缘层围绕所述第二绝缘层;在所述多个沟槽中填充屏蔽导体;在所述多个沟槽的上部形成位于所述屏蔽导体两侧的开口;在所述多个沟槽上部的侧壁上形成栅极电介质;形成栅极导体以填充所述开口;其中,所述栅极导体与所述屏蔽导体之间由所述绝缘叠层中的至少一层彼此隔离,所述栅极导体与所述体区之间由所述栅极电介质彼此隔离,所述屏蔽导体与所述半导体衬底之间由所述绝缘叠层彼此隔离。该方法在屏蔽导体顶部形成隔离层以避免栅源短路。 | ||
搜索关键词: | 功率 半导体器件 及其 制造 方法 | ||
【主权项】:
一种功率半导体器件的制造方法,包括:在第一掺杂类型的半导体衬底中形成多个沟槽;在所述多个沟槽的侧壁和底部上形成绝缘叠层,所述绝缘叠层包括第一绝缘层和第二绝缘层,所述第一绝缘层围绕所述第二绝缘层;在所述多个沟槽中填充屏蔽导体,在所述屏蔽导体的顶部形成第一开口;在所述多个沟槽的上部形成位于所述屏蔽导体两侧的第二开口,所述第二开口暴露所述多个沟槽上部的侧壁;在所述第一开口和所述第二开口中形成隔离层;在所述多个沟槽上部的侧壁上形成栅极电介质;形成栅极导体以填充所述第二开口;在所述半导体衬底邻接沟槽的区域中形成第二掺杂类型的体区,所述第二掺杂类型与所述第一掺杂类型相反;在所述体区中形成所述第一掺杂类型的源区;以及形成源极电极和栅极电极,所述源极电极与所述源区和所述屏蔽导体电连接,所述栅极电极与所述栅极导体电连接,其中,所述栅极导体与所述屏蔽导体之间由所述绝缘叠层中的至少一层彼此隔离,所述栅极导体与所述体区之间由所述栅极电介质彼此隔离,所述屏蔽导体与所述半导体衬底之间由所述绝缘叠层彼此隔离。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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