[发明专利]数字控制延迟线在审
申请号: | 201711204386.8 | 申请日: | 2017-11-27 |
公开(公告)号: | CN108809276A | 公开(公告)日: | 2018-11-13 |
发明(设计)人: | 蔡孟庭;蔡健群;林木山;黄文宏;陈佑齐 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H03K5/14 | 分类号: | H03K5/14 |
代理公司: | 隆天知识产权代理有限公司 72003 | 代理人: | 李昕巍;章侃铱 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | 本公开实施例提供一种数字控制延迟线。数字控制延迟线包括耦接成一链的多个延迟单元耦接成一链,形成一传输路径以传输一输入信号并将输入信号延迟一第一延迟时间。当在链中的一单一延迟单元操作在一反馈模式、于链中在单一延迟单元之前的延迟单元操作在一传输模式、于链中在单一延迟单元之后的一第一后续延迟单元操作在一待机模式,以及于链中在第一延续延迟单元之后的延迟单元操作在一闲置模式时,形成第一传输路径。当单一延迟单元或一对的延迟单元操作在反馈模式时,在单一延迟单元或是该对的延迟单元之后的后续级的延迟单元操作在待机模式,以防止浮动节点的产生,因而当传输路径改变时则无突波会发生。 | ||
搜索关键词: | 延迟单元 传输路径 数字控制 延迟线 反馈模式 耦接 输入信号延迟 在待机模式 传输模式 待机模式 浮动节点 闲置模式 后续级 突波 延迟 传输 | ||
【主权项】:
1.一种数字控制延迟线,包括:多个延迟单元,耦接成一链,形成一第一传输路径以传输一输入信号并将上述输入信号延迟一第一延迟时间,其中每一上述延迟单元具有:一传输模式,用以传输来自一先前级的一延迟单元的一第一信号至一后续级的上述延迟单元,并传输来自上述后续级的上述延迟单元的一第二信号至上述先前级的上述延迟单元;一反馈模式,用以传输来自上述先前级的上述延迟单元的上述第一信号至上述后续级的上述延迟单元并传输回至上述先前级的上述延迟单元;一待机模式,用以传输来自上述先前级的上述延迟单元的上述第一信号至上述后续级的上述延迟单元,并提供一第一高阻抗输出至上述先前级的上述延迟单元;以及一闲置模式,用以提供上述第一高阻抗输出至上述先前级的上述延迟单元,并提供一第二高阻抗输出至上述后续级的上述延迟单元,其中当在上述链中的一单一延迟单元操作在上述反馈模式、于上述链中在上述单一延迟单元之前的上述延迟单元操作在上述传输模式、于上述链中在上述单一延迟单元之后的一第一后续延迟单元操作在上述待机模式,以及于上述链中在上述第一延续延迟单元之后的上述延迟单元操作在上述闲置模式时,形成上述第一传输路径。
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