[发明专利]一种支持动态可重构的一体化数字信号处理系统在审
| 申请号： | 201711445274.1 | 申请日： | 2017-12-27 |
| 公开（公告）号： | CN108182168A | 公开（公告）日： | 2018-06-19 |
| 发明（设计）人： | 肖睿;陈亦欧;凌翔;张恒 | 申请（专利权）人： | 电子科技大学 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 四川力久律师事务所 51221 | 代理人： | 王芸;熊晓果 |
| 地址： | 611731 四川省成*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了一种支持动态可重构的一体化数字信号处理系统，该系统中，上位机将FPGA的可编程硬件资源描述成若干个容量一定的可重构子区域，当重构任务到来时，上位机结合重构任务对应的任务数据集合和当前可重构子区域的使用情况，计算出重构方案并将重构方案转换成重构指令，FPGA根据重构指令调用相应的可重构子区域以及每个可重构子区域对应的比特流文件，使每个可重构子区域内的可编程硬件资源根据相应的比特流文件构建出相应的子硬件电路，并将每个可重构子区域内构建的子硬件电路组织成完整的硬件电路，从而完成重构任务。因此，本发明不仅硬件资源具有更好可塑性，还由于对硬件资源的调度，以时间资源换取空间资源，降低了硬件的成本。 | ||
| 搜索关键词： | 重构 可重构 子区域 硬件电路 数字信号处理系统 比特流文件 动态可重构 可编程硬件 硬件资源 上位机 构建 空间资源 方案转换 任务数据 时间资源 指令调用 资源描述 一体化 可塑性 集合 调度 指令 | ||
【主权项】：
1.一种支持动态可重构的一体化数字信号处理系统，其特征在于，包括上位机和FPGA；其中，所述上位机通过获取所述FPGA的可编程硬件资源信息，将描述成若干个容量一定的可重构子区域，并实时更新所述可重构子区域的使用情况；而且，所述上位机中预先存储有每个重构任务对应的任务数据集合，每个重构任务对应一个任务ID，每个任务数据集合包括对应重构任务所需硬件电路的比特流文件信息和硬件规模信息；当重构任务到来时，所述上位机根据所述重构任务的任务ID，获取所述重构任务的任务数据集合，并结合所述任务数据集合和当前所述可重构子区域的使用情况，计算出所述重构任务的重构方案；而且，所述上位机将计算出的重构方案转换成所述FPGA可识别的重构指令后，再将所述重构指令发送给所述FPGA；所述FPGA存储有用于构建硬件电路的比特流文件，所述FPGA根据所述重构指令，调用相应的可重构子区域以及每个可重构子区域对应的比特流文件，使每个可重构子区域内的可编程硬件资源根据相应的比特流文件构建出相应的子硬件电路，并将每个可重构子区域内构建的子硬件电路组织成完整的硬件电路，以完成所述重构任务。
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