[实用新型]一种用于实现6:2压缩器的ALTERAFPGA原语连接系统有效
| 申请号： | 201721255270.2 | 申请日： | 2017-09-28 |
| 公开（公告）号： | CN207249656U | 公开（公告）日： | 2018-04-17 |
| 发明（设计）人： | 史伟仁;吕春;戴荣;阴陶 | 申请（专利权）人： | 成都傅立叶电子科技有限公司;深圳市特发信息股份有限公司 |
| 主分类号： | G06F7/50 | 分类号： | G06F7/50 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 610000 四川省成都*** | 国省代码： | 四川;51 |
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| 摘要： | 本实用新型涉及一种用于实现62压缩器的ALTERA FPGA原语连接系统，由32CSA(即全加器)为基本单元构造62CSA；在垂直方向上，62CSA的输入为6个RANK均为i的比特，输出为[C，S]；在水平方向上，62CSA有2个RANK均为i的进位输入，有2个RANK分别为i+1和i+2的进位输出，降低ALTERA FPGA逻辑单元中的资源消耗，缩短数据传输链路，降低延迟性。 | ||
| 搜索关键词： | 一种 用于 实现 压缩器 alterafpga 连接 系统 | ||
【主权项】：
一种用于实现6：2压缩器的ALTERA FPGA原语连接系统，其特征在于，结构包括通过加法连接的第一全加器单元(101)、第二全加器单元(102)、第三全加器单元(103)、第四全加器单元(104)和第五全加器单元(105)；所述第一全加器单元(101)、第二全加器单元(102)、第三全加器单元(103)、第四全加器单元(104)和第五全加器单元(105)均设置有三个输入和两个输出；所述第一全加器单元(101)的两个输出分别作为第四全加器单元(104)的一个输入和第三全加器单元(103)的一个输入；所述第二全加器单元(102)的两个输出分别作为第三全加器单元(103)的一个输入和第四全加器单元(104)的一个输入；所述第三全加器单元(103)的两个输出分别作为第四全加器单元(104)的一个输入和第五全加器单元(105)的一个输入。
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