[实用新型]一种嵌入式雷达信号与数据处理装置有效
| 申请号： | 201721476930.X | 申请日： | 2017-11-07 |
| 公开（公告）号： | CN207424241U | 公开（公告）日： | 2018-05-29 |
| 发明（设计）人： | 高元正 | 申请（专利权）人： | 武汉雷博合创电子科技有限公司 |
| 主分类号： | G01S7/02 | 分类号： | G01S7/02 |
| 代理公司： | 北京众合诚成知识产权代理有限公司 11246 | 代理人： | 徐杨松 |
| 地址： | 430000 湖北省武汉市江岸区*** | 国省代码： | 湖北;42 |
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| 摘要： | 本实用新型涉及一种嵌入式雷达信号与数据处理装置，包括FPGA控制电路、信号处理电路、AD转换电路、第一存储器、第二存储器和接口电路。FPGA控制电路包括FPGA和硬核处理电路，FPGA和硬核处理电路通过Avalon总线连接，FPGA分别与信号处理电路和AD转换电路电连接，AD转换电路与外部雷达系统电连接，硬核处理电路分别与接口电路、第一存储器和第二存储器电连接，接口电路与上位机电连接。本实用新型的嵌入式雷达信号与数据处理装置，采用嵌入式FPGA与信号处理电路结合，具有多种外设接口，极大降低了开发的难度和成本，优化了系统的硬件架构，数据存储和读取采用两个存储器的乒乓结构，大大降低了数据传输的延迟，便于低成本大批量生产。 | ||
| 搜索关键词： | 嵌入式 数据处理装置 信号处理电路 存储器 处理电路 接口电路 雷达信号 电连接 硬核 本实用新型 第二存储器 读取 机电连接 雷达系统 乒乓结构 数据传输 数据存储 外设接口 硬件架构 低成本 延迟 外部 优化 开发 生产 | ||
【主权项】：
1.一种嵌入式雷达信号与数据处理装置，其特征在于:包括FPGA控制电路、信号处理电路、AD转换电路、第一存储器、第二存储器和接口电路；所述FPGA控制电路包括FPGA和硬核处理电路，所述FPGA和硬核处理电路通过Avalon总线连接，所述FPGA分别与所述信号处理电路和AD转换电路电连接，所述AD转换电路与外部雷达系统电连接，所述硬核处理电路分别与所述接口电路、第一存储器和第二存储器电连接，所述接口电路与上位机电连接。
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