[发明专利]用于处理文本串的指令和逻辑有效
| 申请号： | 201810003932.X | 申请日： | 2007-09-24 |
| 公开（公告）号： | CN108052348B | 公开（公告）日： | 2022-04-15 |
| 发明（设计）人： | M·朱利耶;J·格雷;S·米克斯;M·塞科尼;S·陈努帕蒂 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30;G06F9/34;G06F9/38;G06F12/0875;G06F7/06 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 刘瑜;王英 |
| 地址： | 美国加*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明提供一种用于处理文本串的指令和逻辑。用于执行串比较操作的方法、装置和程序模块。在一个实施例中，一种装置包括用来执行第一指令的执行资源。响应于所述第一指令，所述执行资源存储分别与第一和第二文本串相对应的第一和第二操作数的每个数据元素之间的比较结果。 | ||
| 搜索关键词： | 用于 处理 文本 指令 逻辑 | ||
【主权项】：
1.一种处理器，包括：多个紧缩数据寄存器，其包括用于存储第一紧缩数据的第一源紧缩数据寄存器和用于存储第二紧缩数据的第二源紧缩数据寄存器；译码器，用于对包括紧缩比较指令的指令进行译码，所述紧缩比较指令标识所述第一源紧缩数据寄存器和所述第二源紧缩数据寄存器，其中，所述第一源紧缩数据寄存器中的每个数据元素对应于所述第二源紧缩数据寄存器中的不同的数据元素，以形成多对相应的数据元素；执行单元，其与所述译码器耦合，并且与所述多个紧缩数据寄存器耦合，响应于对所述紧缩比较指令的译码，所述执行单元用于：比较所述多对相应的数据元素中的仅有效的数据元素；以及存储所述比较的结果。
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