[发明专利]去交织跨距数据元素处理器、方法、系统和指令有效
申请号: | 201810167226.9 | 申请日: | 2018-02-28 |
公开(公告)号: | CN108509219B | 公开(公告)日: | 2023-05-02 |
发明(设计)人: | M.普洛特尼科夫;E.奥尔德-阿梅德-瓦尔 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F9/30 | 分类号: | G06F9/30 |
代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 徐予红;杨美灵 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | 由处理器执行的方法包括接收指令。所述指令指示源操作数、指示跨距、指示出自于对于所指示的跨距的跨距数据元素位置的所有集合中的跨距数据元素位置的至少一个集合、以及指示至少一个目的地打包数据寄存器。该方法还包括响应于所述指令针对跨距数据元素位置的所指示的至少一个集合中的每个而将对应的结果打包数据操作数存储在处理器的对应目的地打包数据寄存器中。每个结果打包数据操作数包括多个数据元素,所述多个数据元素来自源操作数的跨距数据元素位置的对应指示的集合。集合的跨距数据元素位置彼此分开整数倍的所指示的跨距。还公开了其它方法、处理器、系统和机器可读介质。 | ||
搜索关键词: | 交织 跨距 数据 元素 处理器 方法 系统 指令 | ||
【主权项】:
1.一种处理器,包括:多个打包数据寄存器;解码单元,用于解码指令,所述指令用于指示源操作数、用于指示跨距、用于指示出自于对于所指示的跨距的跨距数据元素位置的所有集合中的跨距数据元素位置的至少一个集合、以及用于指示所述多个打包数据寄存器的至少一个目的地打包数据寄存器;以及运行单元,与所述多个打包数据寄存器耦合,并且与所述解码单元耦合,所述运行单元响应于所述指令针对跨距数据元素位置的所指示的至少一个集合中的每个来将对应的结果打包数据操作数存储在所述多个打包数据寄存器的对应的目的地打包数据寄存器中,每个结果打包数据操作数用于包括多个数据元素,所述多个数据元素将会来自所述源操作数的跨距数据元素位置的对应的所指示的集合,其中所述集合的跨距数据元素位置将会彼此分开整数倍的所指示的跨距。
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