[发明专利]制造半导体器件的方法有效
申请号: | 201810194182.9 | 申请日: | 2014-01-24 |
公开(公告)号: | CN108461395B | 公开(公告)日: | 2022-08-23 |
发明(设计)人: | 佃荣次;片山弘造;园田贤一郎;国清辰也 | 申请(专利权)人: | 瑞萨电子株式会社 |
主分类号: | H01L21/283 | 分类号: | H01L21/283;H01L27/115;H01L27/11563;H01L27/11568;H01L27/11573;H01L29/423;H01L21/336;H01L29/792 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | 本发明涉及一种制造半导体器件的方法,包括:(a)在第一区域中经第一绝缘膜在半导体衬底上方形成第一伪栅电极,经第二绝缘膜在半导体衬底上方形成第二伪栅电极,在第二区域中经第三绝缘膜在半导体衬底上方形成第三伪栅电极,第二伪栅电极经第四绝缘膜与第一伪栅电极相邻,第二伪栅电极的高度大于第三伪栅电极的高度;(b)形成层间绝缘层以便与第一至第三伪栅电极的上表面重叠;(c)抛光层间绝缘层、第一至第三伪栅电极的各部分使其上表面从层间绝缘层暴露;(d)去除第一至第三伪栅电极;以及(e)在第一至第三开口部中填充含金属的膜,第一至第三开口部是在步骤(d)中已经去除第一至第三伪栅电极的区域。 | ||
搜索关键词: | 制造 半导体器件 方法 | ||
【主权项】:
1.一种制造半导体器件的方法,所述半导体器件包括形成在半导体衬底的第一区域中的非易失性存储器的存储单元和形成在所述半导体衬底的第二区域中的MOS型晶体管,所述方法包括:(a)在所述第一区域中,经由第一绝缘膜在所述半导体衬底上方形成第一伪栅电极并且经由第二绝缘膜在所述半导体衬底上方形成第二伪栅电极,在所述第二区域中,经由第三绝缘膜在所述半导体衬底上方形成第三伪栅电极,所述第二伪栅电极被设置为经由第四绝缘膜与所述第一伪栅电极相邻,所述第二伪栅电极的从所述半导体衬底的表面到所述第二伪栅电极的上表面的高度大于所述第三伪栅电极的从所述半导体衬底的所述表面到所述第三伪栅电极的上表面的高度;(b)形成层间绝缘层以便与所述第一伪栅电极的上表面、所述第二伪栅电极的所述上表面和所述第三伪栅电极的所述上表面重叠;(c)抛光所述层间绝缘层、所述第一伪栅电极、所述第二伪栅电极和所述第三伪栅电极的各部分,使得所述第一伪栅电极、所述第二伪栅电极和所述第三伪栅电极的所述上表面从所述层间绝缘层暴露;(d)在步骤(c)之后,去除所述第一伪栅电极、所述第二伪栅电极和所述第三伪栅电极;以及(e)在步骤(d)之后,在第一开口部、第二开口部和第三开口部中填充含金属的膜,所述第一开口部是在步骤(d)中已经去除所述第一伪栅电极的区域,所述第二开口部是在步骤(d)中已经去除所述第二伪栅电极的区域,所述第三开口部是在步骤(d)中已经去除所述第三伪栅电极的区域。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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