[发明专利]一种采用延迟链结构的层次式TDC的校正方法有效
申请号: | 201810311310.3 | 申请日: | 2018-04-09 |
公开(公告)号: | CN108445735B | 公开(公告)日: | 2020-04-07 |
发明(设计)人: | 罗敏;王晨旭;刘晓宁;王新胜 | 申请(专利权)人: | 哈尔滨工业大学(威海) |
主分类号: | G04F10/00 | 分类号: | G04F10/00 |
代理公司: | 哈尔滨市松花江专利商标事务所 23109 | 代理人: | 岳昕 |
地址: | 264209*** | 国省代码: | 山东;37 |
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摘要: | 一种采用延迟链结构的层次式TDC的校正方法,涉及时间‑数字转换技术领域。本发明是为了解决数字延迟链TDC中,外部输入信号的上升沿位置关系不确定,进而导致DFF会出现错误输出码的问题。本发明所述的一种对采用延迟链结构的层次式TDC的校正方法,通过比较DFF采样信号沿与被采样信号沿之间的相对位置,以及延迟链测量所得两个信号之间的时间间隔来校正因为不满足DFF建立时间和保持时间而导致的TDC测量错误。 | ||
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【主权项】:
1.一种采用延迟链结构的层次式TDC的校正方法,所述方法为:当开始信号Start到来时,参考时钟计数器对参考时钟CLK计数,同时,开始信号Start被送入延迟链,并获得开始信号Start与参考时钟CLK的时间间隔X,0≤X≤T,其中T表示参考时钟CLK一个周期的时间,当停止信号Stop到来时,参考时钟计数器停止计数并获得开始信号Start和停止信号Stop之间的参考时钟周期数N,同时,停止信号Stop被送入延迟链,并获得停止信号Stop与参考时钟CLK的时间间隔Y,0≤Y≤T,其特征在于,所述校正方法包括对参考时钟周期数N进行校正,该方法包括以下步骤:设中间判断值Z满足0Z,则N=N+1,然后执行步骤二;若开始信号Start的上升沿位于参考时钟CLK上升沿的右侧且XZ、或X=Z,则N=N,然后执行步骤二;步骤二:若停止信号Stop的上升沿位于参考时钟CLK上升沿的左侧且YZ,则N=N‑1,完成N的校正;若停止信号Stop的上升沿位于参考时钟CLK上升沿的左侧且Y>Z、停止信号Stop的上升沿位于参考时钟CLK上升沿的右侧且Y
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