[发明专利]一种填充沟槽形成触点的方法在审
申请号: | 201810649760.3 | 申请日: | 2018-06-22 |
公开(公告)号: | CN108962894A | 公开(公告)日: | 2018-12-07 |
发明(设计)人: | 王宏付 | 申请(专利权)人: | 长鑫存储技术有限公司 |
主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242 |
代理公司: | 上海光华专利事务所(普通合伙) 31219 | 代理人: | 余明伟 |
地址: | 230000 安徽省合肥市*** | 国省代码: | 安徽;34 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明提供一种填充沟槽形成触点的方法,通过控制刻蚀反应压力使得沟槽上部的阶梯覆盖膜的刻蚀移除量大于沟槽下部的阶梯覆盖膜的刻蚀移除量,以降低沟槽形貌的深宽比;藉由沉积及刻蚀循环的方式,完成较高深宽比的无缝隙薄膜填充,避免了缝隙对薄膜结构和电性能的影响;在同一反应室内完成沉积及刻蚀工艺,降低工艺成本;本发明制备动态随机存取存储器的方法可以制备具有无缝隙薄膜填充位线接触沟槽的动态随机存取存储器,并降低工艺复杂性及成本,提高所述动态随机存取存储器的存储能力。 | ||
搜索关键词: | 动态随机存取存储器 刻蚀 填充 沟槽形成 阶梯覆盖 无缝隙 触点 移除 沉积 制备 薄膜 工艺复杂性 薄膜结构 存储能力 反应压力 高深宽比 工艺成本 沟槽形貌 刻蚀工艺 电性能 深宽比 填充位 线接触 室内 | ||
【主权项】:
1.一种填充半导体基底沟槽形成触点的方法,其特征在于,包括如下步骤:S1:提供具有沟槽的半导体基底,并将所述半导体基底置于反应室内;S2:在所述反应室内的所述半导体基底上沉积阶梯覆盖膜,所述阶梯覆盖膜沿着所述半导体基底上方的表面轮廓覆盖所述沟槽的底部及侧壁;S3:在所述反应室内,刻蚀所述沟槽内的所述阶梯覆盖膜,残留的所述阶梯覆盖膜在所述沟槽内形成侧向沉积子层,其中,所述侧向沉积子层形成于所述沟槽侧壁的底面和所述侧向沉积子层相对远离于所述沟槽侧壁的表面形成为锐角关系,使得所述侧向沉积子层的表面非垂直倾斜于所述沟槽底部,以改变所述沟槽在所述侧向沉积子层填充后内缺口形貌的深宽比;S4:在所述半导体基底上沉积触点填充材料层,直至和所述侧向沉积子层共同无缝隙的填满所述沟槽。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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