[发明专利]一种基于IIC总线的数据存储方法及系统在审

专利信息
申请号: 201810759187.1 申请日: 2018-07-11
公开(公告)号: CN109062843A 公开(公告)日: 2018-12-21
发明(设计)人: 郭文郁;马文涛;王纪臣 申请(专利权)人: 河南森源电气股份有限公司
主分类号: G06F13/42 分类号: G06F13/42;G06F12/06
代理公司: 郑州睿信知识产权代理有限公司 41119 代理人: 陈浩
地址: 461500 河*** 国省代码: 河南;41
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摘要: 发明涉及一种基于IIC总线的数据存储方法及系统,该方法包括:给待写入的数据分配地址,对分配地址后的待写入数据进行预处理,并将预处理后的数据进行存储;其中预处理过程包括:若待写入数据总长度大于控制器中IIC外设FIFO队列的长度,则将待写入数据按照IIC外设FIFO队列的长度拆分成多个队列;并每经过一个存储器最小响应时间周期存储一个队列,且每个队列中待写入数据的地址在存储器的一个页面中。本发明通过给待写入的数据分配地址,并对分配地址后的待写入数据进行预处理过程,避免了数据写入时的自动翻页现象;同时将数据以队列的形式分批传送的设计,提高了程序效率,提高了硬件效率。
搜索关键词: 待写入数据 队列 预处理 写入 预处理过程 存储器 分配地址 数据存储 数据分配 外设 存储 响应时间周期 程序效率 硬件效率 自动翻页 控制器 页面 传送
【主权项】:
1.一种基于IIC总线的数据存储方法,其特征在于,步骤如下:给待写入的数据分配地址,对分配地址后的待写入数据进行预处理,并将预处理后的数据进行存储;其中预处理过程包括:若待写入数据总长度大于控制器中IIC外设FIFO队列的长度,则将待写入数据按照IIC外设FIFO队列的长度拆分成多个队列;并每经过一个存储器最小响应时间周期存储一个队列,且每个队列中待写入数据的地址在存储器的一个页面中。
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