[发明专利]3D图形处理的图元装配硬件加速器有效

专利信息
申请号: 201810852931.2 申请日: 2018-07-30
公开(公告)号: CN109035378B 公开(公告)日: 2023-05-09
发明(设计)人: 杜丽娜;石小刚;黄光新 申请(专利权)人: 南京军微半导体科技有限公司
主分类号: G06T15/00 分类号: G06T15/00
代理公司: 合肥禾知知识产权代理事务所(特殊普通合伙) 34246 代理人: 卢双双
地址: 210000 江苏省南京市江*** 国省代码: 江苏;32
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摘要: 发明公开了一种3D图形处理的图元装配硬件加速器,它涉及计算图形学和计算机结构设计领域。本发明可处理10种图元类型(POINTS、LINES、LINE_STRIP、LINE_LOOP、TRIANGLES、TRIANGLE_STRIP、TRIANGLE_FAN、QUADS、QUAD_STRIP、POLYGON),一批次最多处理256个顶点(一个顶点最多包含32个属性)的结构,由于顶点数据量过大,硬件实现采用将从前一级接收的顶点数据全部通过DDR控制器存放至DDR中,装配完成待输出时,再通过缓存CACHE从DDR读取。采用该方法,硬件实现简单,并减少片上存储的使用量。最终基于上述技术获得了一种在兼顾性能的情况下结构紧凑的低功耗设计,在3D图形处理器管线中非性能瓶颈节点任务的功耗降低中可以发挥出相当有价值的作用。
搜索关键词: 图形 处理 装配 硬件 加速器
【主权项】:
1.3D图形处理的图元装配硬件加速器,其特征在于,采用图元装配模块PA,图元装配模块PA包括配置模块、顶点数据输入模块、排序模块、控制模块、预取模块和输出模块,所述的配置模块接收GPU中顶点调度模块VDPR/命令解析模块FEP发送过来的配置信息,解析出图元类型、顶点编号的起始值、顶点编号的数目、顶点编号的批次状态以及顶点存入DDR的基址,将有用信息传递给相应模块;所述的顶点数据输入模块PA接收来自CCU的顶点数据,通过DDR控制器全部存放至DDR中,同时将整批次中的0号索引的数据存放在片上存储DMEM中,另外从顶点数据携带的包头中,解析出有用的索引号和属性状态表,索引号用来计算该顶点数据在DDR中的存放基址;属性状态表用来告诉后续模块该批顶点具体包含哪些属性,以完成顶点数据下发的剪裁模块时地址的匹配;所述的排序模块根据图元类型决定下发给下一模块的索引值,当对应索引值的顶点数据已存入PA时,将该组顶点索引值发送给控制模块;所述的控制模块根据索引组装模块的顶点索引计算出顶点数据在DDR/片上存储中的基址,将该地址发送给预取模块;所述的预取模块根据控制模块发送的地址取出相应的顶点数据发送给输出模块;所述的输出模块按照相应的格式输出顶点数据。
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