[发明专利]3D存储器件及其制造方法有效
申请号: | 201810950486.3 | 申请日: | 2018-08-20 |
公开(公告)号: | CN109119424B | 公开(公告)日: | 2020-08-25 |
发明(设计)人: | 张勇;陶谦;霍宗亮;程卫华;汤强;黄郁茹 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11573 | 分类号: | H01L27/11573;H01L27/11578;H01L23/48 |
代理公司: | 北京成创同维知识产权代理有限公司 11449 | 代理人: | 范芳茗;冯丽欣 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | 本申请公开了一种3D存储器件及其制造方法。所述3D存储器件包括:衬底;堆叠于所述衬底上方的第一叠层结构和第二叠层结构,所述第一叠层结构和第二叠层结构分别包括交替堆叠的多个栅极导体和多个层间绝缘层;以及贯穿所述第一叠层结构和第二叠层结构的多个沟道柱,其中,所述第一叠层结构和所述第二叠层结构的沟道柱相连通,在连接处形成沟道窗口,所述沟道窗口的大小可以改变。该3D存储器件中上下两层叠层结构的叠层层数不同,从而使上下两层沟道层连接处的沟道柱的开口尺寸变大,在进行后续的冲孔过程中获得更大的空间,从而减小或避免连接处沟道柱受损形成泄漏源,也保证了沟道层的连续性,从而提高3D存储器件的良率和可靠性。 | ||
搜索关键词: | 存储 器件 及其 制造 方法 | ||
【主权项】:
1.一种3D存储器件,包括:衬底;堆叠于所述衬底上方的第一叠层结构和第二叠层结构,所述第一叠层结构和第二叠层结构分别包括交替堆叠的多个栅极导体和多个层间绝缘层;以及分别贯穿所述第一叠层结构和第二叠层结构的多个第一沟道柱和多个第二沟道柱,其中,所述多个第一沟道柱与所述多个第二沟道柱彼此连接,并且,所述多个第一沟道柱在所述第一叠层结构上表面的顶部开口尺寸大于所述多个第二沟道柱在所述第二叠层结构上表面的顶部开口尺寸。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的