[发明专利]用于空间阵列中的可配置时钟门控的处理器和方法在审
| 申请号： | 201811001615.0 | 申请日： | 2018-08-30 |
| 公开（公告）号： | CN109597458A | 公开（公告）日： | 2019-04-09 |
| 发明（设计）人： | M·戴蒙德;B·基恩;K·E·弗莱明 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F1/14 | 分类号： | G06F1/14;G06F9/38;G06F9/4401 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 李炜;黄嵩泉 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本申请提供了用于空间阵列中的可配置时钟门控的处理器和方法。描述了关于空间阵列中的可配置时钟门控的方法和装置。在一个实施例中，处理器包括：处理元件；处理元件之间的互连网络；以及配置控制器，耦合至多个处理元件中的第一处理元件和第二处理元件，并且第一处理元件具有耦合至第二处理元件的输入的输出，该配置控制器用于将第二处理元件配置成对第二处理元件的至少一个经时钟计时的组件进行时钟门控，并且将第一处理元件配置成当数据将要从第一处理元件发送到第二处理元件时，在互连网络上将重新启用信号发送到第二处理元件，以便重新启用第二处理元件的至少一个经时钟计时的组件。 | ||
| 搜索关键词： | 处理元件 时钟门控 空间阵列 可配置 处理器 配置控制器 互连网络 耦合 计时 方法和装置 启用信号 成对 配置 输出 申请 | ||
【主权项】：
1.一种处理器，包括：多个处理元件；互连网络，在所述多个处理元件之间，所述互连网络用于接收包括多个节点的数据流图的输入，其中，所述数据流图用于被覆盖到所述互连网络和所述多个处理元件中，并且每个节点被表示为所述互连网络和所述多个处理元件中的数据流操作器，并且所述多个处理元件用于当传入操作数集到达所述多个处理元件时执行操作；以及配置控制器，耦合到所述多个处理元件，所述配置控制器用于：根据所述数据流图的配置信息来配置所述多个处理元件；以及基于所述配置信息对处理元件的至少一个经时钟计时的组件进行时钟门控。
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