[发明专利]高速数据加权平均架构在审
| 申请号： | 201811488874.0 | 申请日： | 2018-12-06 |
| 公开（公告）号： | CN110048715A | 公开（公告）日： | 2019-07-23 |
| 发明（设计）人： | A·巴尔;R·辛格 | 申请（专利权）人： | 意法半导体国际有限公司 |
| 主分类号： | H03M1/06 | 分类号： | H03M1/06 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华 |
| 地址： | 荷兰阿*** | 国省代码： | 荷兰;NL |
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| 摘要： | 本公开的实施例涉及高速数据加权平均架构。温度计编码的输入信号的数据加权平均通过以下来完成：控制交叉开关矩阵的操作以使用响应于数据加权平均输出信号的前一周期的反馈而生成的控制信号来生成数据加权平均输出信号的当前周期。基于前一周期中数据加权平均输出信号的结束逻辑转变的检测，控制信号指定当前周期中针对数据加权平均输出信号的开始逻辑转变的比特位置。 | ||
| 搜索关键词： | 输出信号 数据加权 加权平均 高速数据 控制信号 逻辑转变 架构 交叉开关矩阵 温度计编码 比特位置 生成数据 反馈 响应 检测 | ||
【主权项】：
1.一种用于从温度计码信号生成数据加权平均信号的电路，包括：交叉开关矩阵，具有被配置成接收所述温度计码信号的输入和被配置成输出所述数据加权平均信号的输出，其中通过所述交叉开关矩阵的在所述输入与所述输出之间的变换由交叉选择信号控制；以及控制电路，被配置成接收所述数据加权平均信号的前一时间周期，并且从所述数据加权平均信号的所述前一时间周期的比特来确定所述数据加权平均信号的所述前一时间周期内的其中结束逻辑转变出现的比特位置，并且生成所述交叉选择信号以控制通过所述交叉开关矩阵的在所述输入与所述输出之间的变换，以选择所述数据加权平均信号的当前时间周期内的其中开始逻辑转变出现的比特位置。
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