[发明专利]一种PCIE交换芯片内核及工作方法有效
| 申请号： | 201811600121.4 | 申请日： | 2018-12-26 |
| 公开（公告）号： | CN109684269B | 公开（公告）日： | 2020-06-02 |
| 发明（设计）人： | 杨珂;张建杰;赵姣;张建波 | 申请（专利权）人： | 成都九芯微科技有限公司 |
| 主分类号： | G06F15/17 | 分类号： | G06F15/17;G06F9/54 |
| 代理公司： | 北京德崇智捷知识产权代理有限公司 11467 | 代理人： | 王金双 |
| 地址： | 610200 四川省成都*** | 国省代码： | 四川;51 |
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| 摘要： | 一种PCIE交换芯片内核，包括，前级处理模块和后级处理模块，所述前级处理模块，从每个端口控制器输入侧读取数据包，得到每个数据包的输出端口；用时戳记录每个数据包进入所述前级处理模块的时间并保存；根据数据包的类型和输出端口对数据包进行区分，构建虚拟输出队列，进行队列管理和调度；将调度成功的数据包及包描述符信息发送到后级处理模块；所述后级处理模块，将来自每个输入端口的数据包分类保存在不同源队列中；根据对应的队列信息和队列拥塞反压信息，对不同源队列进行管理和输出调度；将调度成功的数据包发送到端口控制器输出侧接口。本发明还提供一种PCIE交换芯片内核的工作方法，确保PCIE交换机无阻塞低延迟转发数据包。 | ||
| 搜索关键词： | 一种 pcie 交换 芯片 内核 工作 方法 | ||
【主权项】：
1.一种PCIE交换芯片内核，包括，前级处理模块和后级处理模块，其特征在于，所述前级处理模块，从每个端口控制器输入侧读取数据包，得到每个数据包的输出端口；用时戳记录每个数据包进入所述前级处理模块的时间并保存；根据数据包的类型和输出端口对数据包进行区分，构建虚拟输出队列，进行队列管理和调度；将调度成功的数据包及包描述符信息发送到后级处理模块；所述后级处理模块，将来自每个不同输入端口的数据包分类保存在不同源队列中；根据对应的队列信息和队列拥塞反压信息，对不同源队列进行管理和输出调度；将调度成功的数据包发送到端口控制器输出侧接口。
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