[发明专利]一种片上系统及其数据读写处理方法在审
| 申请号： | 201811628604.5 | 申请日： | 2018-12-28 |
| 公开（公告）号： | CN109753480A | 公开（公告）日： | 2019-05-14 |
| 发明（设计）人： | 景蔚亮;王海波;陈邦明 | 申请（专利权）人： | 上海新储集成电路有限公司 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78;G06N3/063 |
| 代理公司： | 上海申新律师事务所 31272 | 代理人： | 俞涤炯 |
| 地址： | 201500 上海市*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提供一种片上系统及其数据读写处理方法，涉及计算机技术领域，适用于片上系统，于所述片上系统内设置一存储阵列和一外围电路；所述外围电路包括一逻辑处理模块和多个页缓存区域，多个所述页缓存区域和所述存储阵列依序组合形成一存储序列，所述逻辑处理模块连接所述存储序列；进行数据读取操作时，所述逻辑处理模块判断所述数据是否被保存于所述页缓存区域内；若是，则所述逻辑处理模块从所述页缓存区域内读取数据并输出；若否，则所述逻辑处理模块从所述存储阵列内读取数据并输出。本发明减少了数据从存储阵列感应到页缓存区域的时间延时，提升了系统的整体性能。 | ||
| 搜索关键词： | 逻辑处理模块 缓存区域 存储阵列 片上系统 存储序列 数据读写 外围电路 计算机技术领域 数据读取操作 输出 时间延时 保存 | ||
【主权项】：
1.一种数据读写处理方法，适用于片上系统，其特征在于，于所述片上系统内设置一存储阵列和一外围电路；所述外围电路包括一逻辑处理模块和多个页缓存区域，多个所述页缓存区域和所述存储阵列依序组合形成一存储序列，所述逻辑处理模块连接所述存储序列；所述数据读写处理方法包括一数据读取过程，具体包括：步骤A1，依照以所述存储阵列为起点，以最后的所述页缓存区域为终点的存储顺序，所述逻辑处理模块将保存于所述存储阵列内的数据依序保存至所述存储序列中的所有所述页缓存区域内；步骤A2，所述逻辑处理模块接收到外部输入的数据读取请求，并判断所述数据读取请求所对应的数据是否被保存于所述页缓存区域内；若是，则所述逻辑处理模块从所述页缓存区域内读取数据并输出；若否，则所述逻辑处理模块从所述存储阵列内读取数据并输出。
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