[发明专利]一种基于绝缘体上硅工艺的相变存储器结构在审
申请号: | 201811647415.2 | 申请日: | 2018-12-29 |
公开(公告)号: | CN109728024A | 公开(公告)日: | 2019-05-07 |
发明(设计)人: | 景蔚亮;陈邦明 | 申请(专利权)人: | 上海新储集成电路有限公司 |
主分类号: | H01L27/24 | 分类号: | H01L27/24;H01L45/00 |
代理公司: | 上海申新律师事务所 31272 | 代理人: | 俞涤炯 |
地址: | 201500 上海市*** | 国省代码: | 上海;31 |
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摘要: | 本发提供一种基于绝缘体上硅工艺的相变存储器结构,属于半导体技术领域,包括:绝缘体层;沉积衬底;阱区;多个存储器单元,形成在n型阱区上并构成存储器单元阵列,位于同一行的多个存储器单元之间由浅沟槽隔离,位于相邻两行的多个存储器单元之间由深沟槽隔离;存储器单元由位于上方的存储部分和位于下方的选通部分构成,选通部分包括由上至下依次连接的顶部电极、覆盖层、相变材料、电热电极以及接触孔,存储部分为PN结结构;多个字线,连接同一行的存储器单元;多个位线,连接同一列的存储器单元。本发明的有益效果:减少基于绝缘体上硅工艺的相变存储器结构工艺步骤和复杂度。 | ||
搜索关键词: | 存储器单元 绝缘体上硅工艺 相变存储器结构 选通 存储 半导体技术领域 存储器单元阵列 浅沟槽隔离 深沟槽隔离 顶部电极 工艺步骤 绝缘体层 相变材料 相邻两行 依次连接 电极 电热 覆盖层 复杂度 接触孔 同一列 个位 衬底 字线 阱区 沉积 | ||
【主权项】:
1.一种基于绝缘体上硅工艺的相变存储器结构,其特征在于,包括:晶圆衬底;绝缘层,于所述晶圆衬底上表面沉积绝缘物质生成所述绝缘层;沉积衬底,于所述绝缘层上表面沉积n型硅生成所述沉积衬底;n型阱区,于所述沉积衬底上部掺杂n型杂质形成所述n型阱区,所述n型阱区的下表面高于所述沉积衬底的下表面;多个存储器单元,所述多个存储器单元形成在所述n型阱区上并构成具有多行和多列的存储器单元阵列,位于同一行的多个所述存储器单元之间由沿所述n型阱区的上表面向下延伸到所述n型阱区内部的浅沟槽进行隔离,位于相邻两行的多个所述存储器单元之间由沿所述沉积衬底的上表面向下延伸到所述绝缘层内部且低于所述沉积衬底的下表面的深沟槽进行隔离;所述存储器单元由位于上方的存储部分和位于下方的选通部分构成,所述存储部分包括由上至下依次连接的顶部电极、覆盖层、相变材料、电热电极以及接触孔,所述接触孔由上到下延伸至所述存储器单元的p型掺杂区的上表面,所述电热电极一端连接所述相变材料,另一端设置在所述接触孔的内壁,所述选通部分包括与所述接触孔连接的所述p型掺杂区和位于所述p型掺杂区下方的所述n型阱区,所述p型掺杂区由位于同一行的相邻所述浅沟槽之间的所述n型阱区的上部掺杂p型杂质后形成,所述p型掺杂区和所述n型阱区构成PN结二极管;多个字线连接单元,每个所述字线连接单元分别形成在所述沉积衬底上且位于所述存储器单元阵列的每一行最外端的所述存储器单元的外侧;多个字线,每个所述字线分别连接一所述字线连接单元,并通过所述字线连接单元连接位于同一行的所有所述存储器单元的所述沉积衬底;多个位线,每个所述位线分别连接位于同一列的所有所述存储器单元的所述顶部电极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
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H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的