[实用新型]延迟元件、延迟线以及电路有效
| 申请号： | 201820289757.0 | 申请日： | 2018-03-01 |
| 公开（公告）号： | CN208063163U | 公开（公告）日： | 2018-11-06 |
| 发明（设计）人： | A·马丁内兹 | 申请（专利权）人： | 意法半导体(鲁塞)公司 |
| 主分类号： | H03K5/14 | 分类号： | H03K5/14 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华 |
| 地址： | 法国*** | 国省代码： | 法国;FR |
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| 摘要： | 一种延迟元件，包括第一XOR逻辑门和第二XOR逻辑门。第一XOR逻辑门的第一输入定义输入端子。第二XOR逻辑门的第一输入连接到第一XOR逻辑门的输出。第二XOR逻辑门的输出定义输出端子。第一和第二XOR逻辑门的第二输入连接到第二输入端子。 | ||
| 搜索关键词： | 输入端子 输入连接 延迟元件 输出端子 输出 延迟线 电路 | ||
【主权项】：
1.一种延迟元件，其特征在于，包括：第一XOR逻辑门，具有定义所述延迟元件的第一输入端子的第一输入；以及第二XOR逻辑门，具有被连接到所述第一XOR逻辑门的输出的第一输入、以及定义所述延迟元件的输出端子的输出，其中所述第一XOR逻辑门的第二输入被连接到所述第二XOR逻辑门的第二输入，所连接的第二输入定义所述延迟元件的第二输入端子。
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