[实用新型]字线控制电路装置以及半导体存储器有效
| 申请号： | 201821876360.8 | 申请日： | 2018-11-14 |
| 公开（公告）号： | CN208834750U | 公开（公告）日： | 2019-05-07 |
| 发明（设计）人： | 张良 | 申请（专利权）人： | 长鑫存储技术有限公司 |
| 主分类号： | G11C29/12 | 分类号： | G11C29/12;G11C29/18 |
| 代理公司： | 北京市铸成律师事务所 11313 | 代理人： | 陈建焕;武晨燕 |
| 地址： | 230000 安徽省合肥市*** | 国省代码： | 安徽;34 |
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| 摘要： | 本实用新型提供了一种字线控制电路装置，包括测试模式输入模块、行地址输入模块以及逻辑译码处理器，测试模式输入模块输出端和行地址输入模块的输出端连接至逻辑译码处理器的信号输入端，逻辑译码处理器的信号输出端与存储阵列的多条字线对应连接；测试模式输入模块用于接收测试模式信号，行地址输入模块用于接收多个行地址信号，逻辑译码处理器用于对多个行地址信号和测试模式信号进行逻辑及译码处理，生成行地址控制信号，行地址控制信号包括至少两位有效开启信号，用于控制非相邻的至少两条字线同时打开。排除了由于接触区断开或者阻抗太大对测试的影响，提高了测试的准确度。 | ||
| 搜索关键词： | 输入模块 逻辑译码 行地址 处理器 测试模式 字线控制电路 行地址信号 字线 半导体存储器 测试模式信号 地址控制信号 本实用新型 输出端连接 信号输出端 信号输入端 测试 存储阵列 接收测试 开启信号 控制信号 模式信号 译码处理 准确度 接触区 输出端 阻抗 断开 成行 | ||
【主权项】：
1.一种字线控制电路装置，其特征在于，包括测试模式输入模块、行地址输入模块以及逻辑译码处理器，测试模式输入模块输出端和行地址输入模块的输出端连接至所述逻辑译码处理器的信号输入端，所述逻辑译码处理器的信号输出端与存储阵列的多条字线对应连接；所述测试模式输入模块用于接收测试模式信号，所述行地址输入模块用于接收多个行地址信号，所述逻辑译码处理器用于对所述多个行地址信号和所述测试模式信号进行逻辑及译码处理，生成行地址控制信号，所述行地址控制信号包括至少两位有效开启信号，用于控制非相邻的至少两条字线同时打开。
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