[发明专利]满足用于相对于时钟的重复信号的设置/保持时间有效

专利信息
申请号: 201880014749.8 申请日: 2018-03-05
公开(公告)号: CN110366822B 公开(公告)日: 2023-07-07
发明(设计)人: P·J·克莱默;M·H·奇尔德斯;R·C·塔夫特 申请(专利权)人: 德克萨斯仪器股份有限公司
主分类号: H03K5/135 分类号: H03K5/135
代理公司: 北京纪凯知识产权代理有限公司 11245 代理人: 徐东升
地址: 美国德*** 国省代码: 暂无信息
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摘要: 在所描述的示例中,用于捕捉相对于时钟的重复信号的时钟生成包括:时钟电路系统,其在时钟周期(TCLOCK)内提供具有有效时钟边沿(101)和无效时钟边沿(102)的时钟(100);以及信号捕捉电路系统,其基于确定设置/保持窗口(13)的预定设置和保持时间(tSETUP/tHOLD),在有效时钟边沿处捕捉重复信号转变(20、21/22)。时钟相位调整电路系统被配置为调整时钟相位,使得重复信号转变(20、21)发生在设置/保持窗口(13)之间的信号捕捉窗口(14)内。时钟相位调整可以基于:将时钟无效边沿(102)与重复信号转变(21)对齐;和/或将时钟和重复信号转变的连续相位比较取平均;和/或选择性地执行初始极性反转以生成极性反转时钟,然后调整极性反转时钟的时钟相位。一种示例性实施方式是JESD204B(子类1),其相对于SYSREF时序基准控制信号来调整DEVCLK相位。
搜索关键词: 满足 用于 相对于 时钟 重复 信号 设置 保持 时间
【主权项】:
1.一种电路,其包括用于捕捉相对于时钟的重复信号的时钟模块,所述电路包括:信号输入端,其接收具有重复信号转变的重复信号;时钟电路系统,其在时钟周期内提供具有有效时钟边沿和无效时钟边沿的时钟;信号捕捉电路系统,其基于确定设置/保持窗口的预定设置和保持时间,在有效时钟边沿处捕捉所述重复信号转变;以及时钟相位调整电路系统,其调整时钟相位,以使所述重复信号转变发生在设置/保持窗口之间的信号捕捉窗口内。
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