[发明专利]分数时钟发生器有效
| 申请号： | 201880070543.7 | 申请日： | 2018-10-31 |
| 公开（公告）号： | CN111295842B | 公开（公告）日： | 2023-03-24 |
| 发明（设计）人： | D·贾殷;M·F·迪特尔 | 申请（专利权）人： | 德州仪器公司 |
| 主分类号： | H03L7/00 | 分类号： | H03L7/00;H04B1/40 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 11287 | 代理人： | 林斯凯 |
| 地址： | 美国德*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种分数时钟发生器(104)包含全象限模拟内插器(206)。具有最小抖动的正交时钟信号(204)提供到所述全象限模拟内插器(206)。所述全象限模拟内插器(206)基于数字输入值使用一系列开关和电流源来产生差分输出信号，从而允许对所述全象限模拟内插器(206)产生的延迟进行数字控制。所述全象限模拟内插器(206)的所述差分输出提供到多级比较器(208)。所述多级比较器(208)的输出提供到整数分频器(210)以提供最终输出时钟。数字控制部分(212)利用ΣΔ调制器(214)和求和器(216)来利用输入N.α控制输入，所述N.α控制输入提供期望的分数分频量，以向相位累加器(218)提供信号。所述相位累加器(218)的输出是所述全象限模拟内插器(206)的数字控制值或β值。 | ||
| 搜索关键词： | 分数 时钟发生器 | ||
【主权项】：
暂无信息
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