[发明专利]动态比较器及电子设备有效
| 申请号： | 201910117896.4 | 申请日： | 2019-02-15 |
| 公开（公告）号： | CN109861672B | 公开（公告）日： | 2022-03-29 |
| 发明（设计）人： | 徐代果;蒋和全;于晓权;徐世六;李儒章;王健安;陈光炳;王育新;付东兵 | 申请（专利权）人： | 中国电子科技集团公司第二十四研究所 |
| 主分类号： | H03K5/24 | 分类号： | H03K5/24 |
| 代理公司： | 上海光华专利事务所(普通合伙) 31219 | 代理人： | 尹丽云 |
| 地址： | 400060 *** | 国省代码： | 重庆;50 |
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| 摘要： | 本发明提供一种动态比较器，包括：时钟信号模块，用于产生第一时钟信号、第二时钟信号与第三时钟信号；正反馈通道，分别连接预放大器与正反馈锁存器，当第三时钟信号为低电平时，提升连接在预放大器与正反馈锁存器之间的两个节点电压Tp和Tn之间的电压差；当第一、二时钟信号为低电平时，节点电压Tp和Tn被上拉到电源电压进入到复位状态而输出高电平，经反相处理得到为低电平Ip和In反馈控制预放大器；当第一时钟信号为高电平时，第二时钟信号仍为低电平，预放大器处于工作状态放大输入信号输出有电压差的节点电压Tp和Tn，当第二时钟信号变为高电平时，节点电压Tp和Tn之间的电压差使得正反馈锁存器进入锁存状态，完成比较工作输出电压信号Dp和Dn。 | ||
| 搜索关键词： | 动态 比较 电子设备 | ||
【主权项】：
1.一种动态比较器，其特征在于，包括：时钟信号模块，用于产生第一时钟信号CLK1、第二时钟信号CLK2与第三时钟信号CLKn1，其中，所述第二时钟信号CLK2由第一时钟信号CLK1延迟生成；所述第三时钟信号CLKn1由第一时钟信号CLK1反相处理而成；正反馈通道，其分别连接预放大器与正反馈锁存器，当所述第三时钟信号CLKn1为低电平时，提升连接在所述预放大器与正反馈锁存器之间的两个节点电压Tp和Tn之间的电压差；当第一时钟信号CLK1与第二时钟信号CLK2为低电平时，所述节点电压Tp和Tn被上拉到电源电压进入到复位状态而输出高电平，经反相处理得到为低电平Ip和In反馈控制所述预放大器；当所述第一时钟信号CLK1为高电平时，所述第二时钟信号CLK2仍为低电平，所述预放大器处于工作状态放大输入信号输出有电压差的节点电压Tp和Tn，而当所述第二时钟信号CLK2变为高电平时，节点电压Tp和Tn之间的电压差使得所述正反馈锁存器进入锁存状态，完成比较工作输出电压信号Dp和Dn。
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