[发明专利]多通道模式下逻辑通道对齐方法及系统在审
| 申请号： | 201910151655.1 | 申请日： | 2019-02-28 |
| 公开（公告）号： | CN109861807A | 公开（公告）日： | 2019-06-07 |
| 发明（设计）人： | 李娜;刘福;谢秋红 | 申请（专利权）人： | 烽火通信科技股份有限公司 |
| 主分类号： | H04L5/00 | 分类号： | H04L5/00 |
| 代理公司： | 武汉智权专利代理事务所(特殊普通合伙) 42225 | 代理人： | 王维 |
| 地址： | 430000 湖北省武*** | 国省代码： | 湖北;42 |
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| 摘要： | 本发明公开了一种多通道模式下逻辑通道对齐方法及系统，涉及通信技术领域，多通道模式下逻辑通道对齐方法包括以下步骤：计算目标逻辑通道相对于参考逻辑通道的延时偏差数值P；将目标逻辑通道和参考逻辑通道同一时刻的数据分别写入不同RAM的同一地址；当参考逻辑通道的写入地址在最大延时偏差值时，参考逻辑通道从对应RAM的/0地址开始读取数据，目标逻辑通道根据P从对应RAM的相应地址开始读取数据。本发明中的多通道模式下逻辑通道对齐方法，其能消除多通道数据在线路上传输延时不一致而产生的偏移。 | ||
| 搜索关键词： | 逻辑通道 多通道模式 对齐 参考 目标逻辑 通信技术领域 多通道数据 传输延时 计算目标 同一地址 同一时刻 写入地址 延时偏差 最大延时 不一致 偏移 写入 | ||
【主权项】：
1.一种多通道模式下逻辑通道对齐方法，其特征在于，该方法包括以下步骤：计算目标逻辑通道相对于参考逻辑通道的延时偏差数值P；将目标逻辑通道和参考逻辑通道同一时刻的数据分别写入不同RAM的同一地址；当参考逻辑通道的写入地址在最大延时偏差值时，参考逻辑通道从对应RAM的/0地址开始读取数据，目标逻辑通道根据P从对应RAM的相应地址开始读取数据。
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