[发明专利]集成电路网表生成方法、装置、计算机设备及存储介质有效
| 申请号： | 201910212246.8 | 申请日： | 2019-03-20 |
| 公开（公告）号： | CN110046394B | 公开（公告）日： | 2019-12-27 |
| 发明（设计）人： | 刘建华;孙杰 | 申请（专利权）人： | 广东高云半导体科技股份有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 44325 深圳众鼎专利商标代理事务所(普通合伙) | 代理人： | 黄章辉 |
| 地址： | 510000 广东省广*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种集成电路网表生成方法、装置、计算机设备及存储介质。该方法包括获取原始设计文件并对原始设计文件进行识别，获取原始设计文件对应的设计层级模式；采用FPGA综合工具对原始设计文件进行逻辑综合处理，获取原始设计文件对应的输出层级模式和原始集成电路网表中包括的原始模块名称、原始器件名称和原始信号名称；依据设计层级模式和输出层级模式，对原始集成电路网表中的原始模块名称、原始器件名称和原始信号名称进行重命名，获取目标模块名称、目标器件名称和目标信号名称，以生成目标集成电路网表，使得目标集成电路网表中的目标模块名称、目标器件名称和目标信号名称携带有设计信息，并达到命名唯一性的要求。 | ||
| 搜索关键词： | 集成电路网表 原始设计 层级模式 计算机设备 存储介质 目标器件 目标信号 原始模块 原始器件 原始信号 获取目标 逻辑综合 名称携带 目标模块 设计信息 综合工具 唯一性 输出 | ||
【主权项】：
1.一种集成电路网表生成方法，其特征在于，包括：/n获取原始设计文件，所述原始设计文件包括至少一个功能模块；/n对所述原始设计文件进行识别，获取所述原始设计文件对应的设计层级模式；/n采用FPGA综合工具对所述原始设计文件进行逻辑综合处理，获取所述原始设计文件对应的输出层级模式和原始集成电路网表，所述原始集成电路网表包括原始模块名称、原始器件名称和原始信号名称；/n依据所述设计层级模式和所述输出层级模式，对所述原始集成电路网表中的原始模块名称、原始器件名称和原始信号名称进行重命名，获取目标模块名称、目标器件名称和目标信号名称；/n基于所述目标模块名称、所述目标器件名称和所述目标信号名称更新所述原始集成电路网表，获取目标集成电路网表。/n
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