[发明专利]一种超导数字电路设计方法有效
| 申请号： | 201910278235.X | 申请日： | 2019-04-09 |
| 公开（公告）号： | CN110032792B | 公开（公告）日： | 2022-11-11 |
| 发明（设计）人： | 王镇;李秀婷;高小平;任洁;应利良 | 申请（专利权）人： | 中国科学院上海微系统与信息技术研究所 |
| 主分类号： | G06F30/398 | 分类号： | G06F30/398 |
| 代理公司： | 上海泰博知识产权代理有限公司 31451 | 代理人： | 钱文斌 |
| 地址： | 200050 *** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提供一种超导数字电路设计方法，包括：基于超导数字电路的设计需求进行系统架构设计和功能设计后生成电路设计网表；对所述电路设计网表中任一数据通路上的所有单元电路的所有端口均进行磁通存储能力检测，并在端口具有磁通存储能力时，于该端口处增设一缓冲单元，以此实现对所述电路设计网表的时序优化，从而得到终端电路设计网表；对所述终端电路设计网表进行逻辑功能验证及时序验证后生成超导数字电路版图，并对所述超导数字电路版图进行物理验证以完成超导数字电路设计。通过本发明解决了现有采用单元库设计方法进行超导数字电路设计时，因同一超导数字单元电路后接不同负载而引起的超导数字电路时序分析准确性较低的问题。 | ||
| 搜索关键词： | 一种 超导 数字 电路设计 方法 | ||
【主权项】：
1.一种超导数字电路设计方法，其特征在于，所述设计方法包括：基于超导数字电路的设计需求进行系统架构设计和功能设计后生成电路设计网表；对所述电路设计网表中任一数据通路上的所有单元电路的所有端口均进行磁通存储能力检测，并在端口具有磁通存储能力时，于该端口处增设一缓冲单元，以此实现对所述电路设计网表的时序优化，从而得到终端电路设计网表；对所述终端电路设计网表进行逻辑功能验证及时序验证后生成超导数字电路版图，并对所述超导数字电路版图进行物理验证以完成超导数字电路设计。
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