[发明专利]ZYNQ FPGA芯片及其数据处理方法、存储介质有效
| 申请号： | 201910533699.0 | 申请日： | 2019-06-19 |
| 公开（公告）号： | CN110309088B | 公开（公告）日： | 2021-06-08 |
| 发明（设计）人： | 朱琳;韩布和;曲春雨;陈振;王天飞;张红光;喻友平 | 申请（专利权）人： | 北京百度网讯科技有限公司 |
| 主分类号： | G06F13/32 | 分类号： | G06F13/32;G06F15/78 |
| 代理公司： | 北京同立钧成知识产权代理有限公司 11205 | 代理人： | 朱颖;刘芳 |
| 地址： | 100085 北京市*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供一种ZYNQ FPGA芯片及其数据处理方法、存储介质，PS部分配置PL部分的PEA中PE的运算参数，并使能PE的计算启动；PEA根据PE的运算参数，确定读命令和写命令，以及写命令的个数，分别将读/写命令发送至DMA控制器的读/写命令接口；DMA控制器根据读命令，启动从外部存储设备读取数据流程，并将读取到的数据发送至PEA；PEA根据读取到的数据进行计算，将计算结果写回DMA控制器；DMA控制器将计算结果传输至外部存储设备，等待传输结束将每个写命令对应的结束标志信号发回PEA；PEA在接收到与写命令的个数相同数目的结束标志信号后，发送中断至PS部分，有效提高处理深度学习模型的整体性能。 | ||
| 搜索关键词： | zynq fpga 芯片 及其 数据处理 方法 存储 介质 | ||
【主权项】：
1.一种数据处理方法，其特征在于，应用于ZYNQ FPGA芯片，所述ZYNQ FPGA芯片包括处理系统PS部分和可编程逻辑PL部分，所述PS部分与所述PL部分共享外部存储设备，所述外部存储设备挂载在所述PS部分；所述数据处理方法，包括：所述PS部分配置所述PL部分的运算单元阵列PEA中PE的运算参数，并使能所述PE的计算启动，所述PE为深度学习模型中的神经网络层对应的处理模块；所述PEA根据所述PE的运算参数，确定读命令和写命令，以及所述写命令的个数，并将所述读命令发送至直接存储器访问DMA控制器的读命令接口，将所述写命令发送至所述DMA控制器的写命令接口；所述DMA控制器根据所述读命令，启动从所述外部存储设备读取数据流程，并将读取到的数据发送至所述PEA；所述PEA根据所述读取到的数据进行计算，并将计算结果写回所述DMA控制器；所述DMA控制器将所述计算结果传输至所述外部存储设备，并等待传输结束将每个写命令对应的结束标志信号发回所述PEA；所述PEA在接收到与所述写命令的个数相同数目的结束标志信号后，发送中断至所述PS部分。
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