[发明专利]一种闪存器件的制造方法在审
申请号: | 201910537524.7 | 申请日: | 2019-06-20 |
公开(公告)号: | CN110137085A | 公开(公告)日: | 2019-08-16 |
发明(设计)人: | 张超然;周俊;李赟 | 申请(专利权)人: | 武汉新芯集成电路制造有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/423;H01L27/11521 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 党丽 |
地址: | 430205 湖北*** | 国省代码: | 湖北;42 |
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摘要: | 本申请提供一种闪存器件的制造方法,衬底上形成有浮栅层,浮栅层上形成有图案化的栅堆叠层,栅堆叠层一侧为擦除栅区,另一侧为字线区,在栅堆叠层的侧壁上可以形成沿着侧壁由内至外依次层叠的N个子侧墙,去除字线区的侧墙,以擦除栅区的侧墙为掩蔽,进行浮栅层的刻蚀,以形成浮栅,这样,在每一次阶梯成形工艺中可以去除一个子侧墙,并以剩下的子侧墙为掩蔽,各向异性刻蚀去除部分厚度的浮栅,依次进行M次阶梯成形工艺,去除剩余的子侧墙,以在擦除栅区一侧的浮栅中形成阶梯结构,由于擦除栅区一侧的浮栅为阶梯结构,则擦除栅区一侧的浮栅具有更多的尖角,这样在擦除栅上施加电压,将更容易擦除浮栅中的电子,擦除效率得以提高。 | ||
搜索关键词: | 擦除栅 侧墙 浮栅 去除 浮栅层 栅堆叠 掩蔽 阶梯成形 阶梯结构 闪存器件 字线区 侧壁 各向异性刻蚀 擦除效率 施加电压 依次层叠 图案化 擦除 衬底 尖角 刻蚀 制造 申请 | ||
【主权项】:
1.一种闪存器件的制造方法,其特征在于,包括:提供衬底,所述衬底上形成有浮栅层,所述浮栅层上形成有图案化的栅堆叠层,所述栅堆叠层包括依次层叠的隔离层和控制栅,所述栅堆叠层一侧为擦除栅区、另一侧为字线区;在所述栅堆叠层的侧壁上形成侧墙,所述侧墙包括沿所述侧壁由内至外依次层叠的N个子侧墙,所述N≥2且为自然数;去除所述字线区的侧墙,并以所述擦除栅区的侧墙为掩蔽,进行所述浮栅层的刻蚀,以形成浮栅;依次进行M次阶梯成形工艺,以在所述擦除栅区一侧的浮栅中形成阶梯结构,所述M≤N‑1,其中,第m次阶梯成形工艺包括:去除第N+1‑m个子侧墙,并以剩余的子侧墙为掩蔽,各向异性刻蚀去除部分厚度的浮栅,所述m从1至M;去除剩余的子侧墙。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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