[发明专利]基于忆阻器的神经网络的并行加速方法及处理器、装置有效
| 申请号： | 201911082236.3 | 申请日： | 2019-11-07 |
| 公开（公告）号： | CN110807519B | 公开（公告）日： | 2023-01-17 |
| 发明（设计）人： | 吴华强;姚鹏;高滨;钱鹤 | 申请（专利权）人： | 清华大学 |
| 主分类号： | G06N3/04 | 分类号： | G06N3/04;G06N3/08;G11C13/00 |
| 代理公司： | 北京市柳沈律师事务所 11105 | 代理人： | 彭久云 |
| 地址： | 10008*** | 国省代码： | 北京;11 |
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| 摘要： | 一种基于忆阻器的神经网络的并行加速方法及处理器、装置。该神经网络包括：多个依次设置的功能层，其中，该多个功能层包括第一功能层和位于第一功能层之后的第二功能层，该第一功能层包括并行的多个第一忆阻器阵列，该多个第一忆阻器阵列用于执行所述第一功能层的操作并将操作结果输出至第二功能层。该并行加速方法包括：使用多个第一忆阻器阵列并行地执行第一功能层的操作，并将操作结果输出至第二功能层。同时，针对具体的并行加速处理器，设计了合适的硬件架构，该并行加速处理器及装置可以执行上述并行加速方法。 | ||
| 搜索关键词： | 基于 忆阻器 神经网络 并行 加速 方法 处理器 装置 | ||
【主权项】：
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