[发明专利]可配置的处理器间同步系统在审
| 申请号： | 201911353795.3 | 申请日： | 2019-12-25 |
| 公开（公告）号： | CN111382112A | 公开（公告）日： | 2020-07-07 |
| 发明（设计）人： | B.杜蓬特德丁奇恩;A.奥蒂诺特;V.雷 | 申请（专利权）人： | 卡雷公司 |
| 主分类号： | G06F15/173 | 分类号： | G06F15/173 |
| 代理公司： | 北京市柳沈律师事务所 11105 | 代理人： | 邸万奎 |
| 地址： | 法国*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明涉及一种处理器间同步系统，包括多个处理器(PE)；连接链中的处理器的多个单向通知行(FN，BN)；在每个处理器(PEi)中：同步寄存器(FE)，其具有分别与通知行相关联的位，同步寄存器(FE)被连接以记录由上游处理器(PEi‑1)传播的上游通知行(FNin)的相应状态，以及门(12)，其由配置寄存器(FM)控制以将下游通知行(FNout)上的上游通知行(FNin)的状态传播到下游处理器(PEi+1)。 | ||
| 搜索关键词： | 配置 处理器 同步 系统 | ||
【主权项】：
暂无信息
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