[实用新型]支持实现精确延时处理的电路结构有效
| 申请号： | 201920174865.8 | 申请日： | 2019-01-31 |
| 公开（公告）号： | CN209517154U | 公开（公告）日： | 2019-10-18 |
| 发明（设计）人： | 刘景鑫;赵成成 | 申请（专利权）人： | 上海创远仪器技术股份有限公司 |
| 主分类号： | H04B17/391 | 分类号： | H04B17/391;H04B17/364;H04B17/10 |
| 代理公司： | 上海智信专利代理有限公司 31002 | 代理人： | 王洁;郑暄 |
| 地址： | 201601 上海*** | 国省代码： | 上海;31 |
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| 摘要： | 本实用新型涉及一种针对超大带宽无线信道仿真支持实现精确延时处理的电路结构，包括大步进延时模块组，包含多个大步进延时模块，所述的多个大步进延时模块的输出端和输入端依次串联；小步进整数延时模块组，包含多个多相位的移位寄存器，所述的各个移位寄存器的输入端分别与所述的多个大步进延时模块的输出端相连接；小数延时模块组，包含多个小数延时模块，所述的各个小数延时模块的输入端分别与所述的多个移位寄存器的输出端相连接。采用了该电路结构，对数据进行多相处理，以便在低速时钟下实现对高速数据的处理，实现了信道模拟器的多径延时功能和实现了超大带宽的处理能力，且具有较高的延时分辨率，以满足信道模拟器的功能需求。 | ||
| 搜索关键词： | 延时模块 移位寄存器 电路结构 小数 输入端 信道模拟器 延时处理 带宽 无线信道仿真 本实用新型 低速时钟 多径延时 高速数据 功能需求 依次串联 输出 多相位 分辨率 输出端 小步 延时 | ||
【主权项】：
1.一种支持实现精确延时处理的电路结构，其特征在于，所述的电路结构包括：大步进延时模块组；小步进整数延时模块组，所述的小步进整数延时模块组的输入端与所述的大步进延时模块组的输出端相连接；小数延时模块组，包含多个小数延时模块，所述的各个小数延时模块的输入端与所述的小步进整数延时模块组的输出端相连接。
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