[实用新型]一种无人机图像快速传输电路有效

专利信息
申请号: 201920618745.2 申请日: 2019-04-30
公开(公告)号: CN209517371U 公开(公告)日: 2019-10-18
发明(设计)人: 王宇驰;杜虹玥;何泽聪;朱天成 申请(专利权)人: 中国计量大学
主分类号: H04N7/18 分类号: H04N7/18;H04N19/42
代理公司: 杭州求是专利事务所有限公司 33200 代理人: 邱启旺
地址: 310018 浙江省*** 国省代码: 浙江;33
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摘要: 实用新型涉及一种无人机图像快速传输电路,包括网络模块、电源模块、微处理器模块和解码模块;所述电源模块为整个电路提供工作电压,所述网络模块和解码模块均与微处理器模块相连;网络模块通过无线与无人机相连;电源模块将外部输入电源引入电路并为其他模块的工作提供正常稳定额工作电压;网络模块接受无人机所发送的图像信息并将所接收到的图像信息传输给微处理器模块;微处理器模块处理所获得的信息,并向解码模块发送信号;解码模块将图像信息还原成可供其他显示设备利用的信息数据,以供输出。具有快速接收并传输无人机所拍摄图像的优点。
搜索关键词: 微处理器模块 网络模块 电源模块 电路 无人机图像 工作电压 解码模块 快速传输 图像信息 图像信息传输 外部输入电源 本实用新型 电路提供 发送信号 拍摄图像 显示设备 信息数据 还原 发送 传输 输出 引入
【主权项】:
1.一种无人机图像快速传输电路,其特征在于,包括网络模块、电源模块、微处理器模块和解码模块;所述电源模块为整个电路提供工作电压,所述网络模块和解码模块均与微处理器模块相连;网络模块通过无线与无人机相连;所述解码模块包括编解码芯片ADV212、晶振Y2、电容C3‑C4、编解码芯片ADV7301、插座P1‑P2、电阻R1‑10、非极性电容C23‑C26、极性电容C22;晶振Y2的第一时钟端口与电容C3的一端相连后接编解码芯片ADV212的VCLK视频数据时钟端口,晶振Y2的第二时钟端口与电容C4的一端相连后接相连编解码芯片ADV212的MCLK系统输入时钟端口,电容C3的另一端和电容C4另一端均接地;编解码芯片ADV212的数据传输接口接微处理器模块的输出端口,编解码芯片ADV212的FIELD视频模式的字段同步端口连微处理器模块的同步收发端口,编解码芯片ADV212的VSYNC垂直同步视频模式端口连微处理器模块的存储控制端口,编解码芯片ADV212的VCLK视频数据时钟端口连编解码芯片ADV7301的像素时钟输入端口,编解码芯片ADV212的DREQ0外部DMA接口的数据请求端口连微处理器模块的精简独立接口,编解码芯片ADV212的IRQ可编程端口连微处理器模块的存储控制端口,编解码芯片ADV212的ACK直接注册访问端口连微处理器模块的异步收发器串口,编解码芯片ADV212的RD读取端口连微处理器模块的输出端口,编解码芯片ADV212的WE写入端口连微处理器模块的输出端口,编解码芯片ADV212的CS组件选通端口连微处理器模块的输出端口,编解码芯片ADV212的地址总线端口连微处理器模块的存储控制端口;编解码芯片ADV7301的RESET复位端口分别连极性电容C22的正极和电阻R1的一端,极性电容C22的负极接地,电阻R1另一端接3.3V电压;编解码芯片ADV7301的EXT_LF外部非正常锁相回路端口分别连非极性电容C24的一端和电阻R2的一端,非极性电容C24另一端接3.3V电压,电阻R2另一端连非极性电容C23的一端,非极性电容C23的另一端接3.3V电压;编解码芯片ADV7301的RSET2定时生成器端口连电阻R3的一端,电阻R3的另一端接地;编解码芯片ADV7301的COMP2像素时钟输入端口连非极性电容C25的一端,非极性电容C25的另一端接3.3V电压;编解码芯片ADV7301的DAC F模拟蓝色输出端口连电阻R4的一端,电阻R4的另一端接地;编解码芯片ADV7301的模拟红色输出端口DAC E连电阻R5的一端,电阻R5的另一端接地;编解码芯片ADV7301的DAC D模拟绿色输出端口连电阻R6的一端,电阻R6的另一端接地;编解码芯片ADV7301的DACC模拟地面红色输出端口连电阻R7的一端,电阻R7的另一端接地;编解码芯片ADV7301的DAC B模拟地面蓝色输出端口连电阻R8的一端,电阻R8的另一端接地;编解码芯片ADV7301的DAC A模拟地面绿色输出端口连电阻R9的一端,电阻R9的另一端接地;编解码芯片ADV7301的COMP1像素时钟输入端口连非极性电容C26的一端,非极性电容C26的另一端接3.3V电压;编解码芯片ADV7301的RSET1定时生成器端口连电阻R10的一端,电阻R10的另一端接地;插头P1的S0‑S9输入端口分别与编解码芯片ADV7301的S0‑S9输入端口相连;插头P2的Y0‑Y9输入端口分别与编解码芯片ADV7301的Y0‑Y9输入端口相连;编解码芯片ADV7301的C0‑C9十位渐进扫描输入端口与编解码芯片ADV212的十个视频数据传输端口相连;编解码芯片ADV7301的SDA数据输入端口与微处理器模块的输入端口相连;编解码芯片ADV7301的SCLK时钟输入与微处理器模块的时钟端口相连;编解码芯片ADV7301的CLKIN_A像素时钟输入端口与编解码芯片ADV212的VCLK视频数据时钟端口相连。
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