[实用新型]乘法器、装置、芯片及电子设备有效
| 申请号： | 201921433489.6 | 申请日： | 2019-08-30 |
| 公开（公告）号： | CN210006083U | 公开（公告）日： | 2020-01-31 |
| 发明（设计）人： | 不公告发明人 | 申请（专利权）人： | 上海寒武纪信息科技有限公司 |
| 主分类号： | G06N3/063 | 分类号： | G06N3/063;G06F7/523 |
| 代理公司： | 11606 北京华进京联知识产权代理有限公司 | 代理人： | 孙岩 |
| 地址： | 200120 上海市浦*** | 国省代码： | 上海;31 |
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| 摘要： | 本申请提供一种乘法器、芯片及电子设备，所述乘法器包括：正则有符号数编码电路，畸形华莱士树组电路和累加电路，所述正则有符号数编码电路的输出端与所述畸形华莱士树组电路的输入端连接，所述畸形华莱士树组电路的输出端与所述累加电路的输入端连接，该乘法器能够通过正则有符号数编码电路对接收到的数据进行正则有符号数编码，得到的有效部分积的数目较少，从而降低了乘法器实现乘法运算的复杂性。 | ||
| 搜索关键词： | 乘法器 符号数 编码电路 输入端连接 电路 畸形 累加电路 输出端 乘法运算 电子设备 芯片 申请 | ||
【主权项】：
1.一种乘法器，其特征在于，所述乘法器包括：正则有符号数编码电路、畸形华莱士树组电路和累加电路，所述正则有符号数编码电路的输出端与所述畸形华莱士树组电路的输入端连接，所述畸形华莱士树组电路的输出端与所述累加电路的输入端连接，其中，所述正则有符号数编码电路包括：正则有符号数编码子电路和部分积获取子电路，所述正则有符号数编码子电路的输出端与所述部分积获取子电路的输入端连接；/n所述正则有符号数编码子电路用于对接收到的数据进行正则有符号数编码处理得到目标编码，所述部分积获取子电路用于根据所述目标编码得到原始部分积，并对所述原始部分积进行优化处理，得到所述目标编码的部分积，所述畸形华莱士树组电路用于对所述目标编码的部分积进行累加处理得到累加运算结果，所述累加电路用于对所述累加运算结果进行加法运算。/n
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