[发明专利]整数模式数字锁相环的摆动减少在审
| 申请号： | 201980014937.5 | 申请日： | 2019-03-11 |
| 公开（公告）号： | CN111742493A | 公开（公告）日： | 2020-10-02 |
| 发明（设计）人： | J·贾纳德哈南;E·P·林格伦;H·姚 | 申请（专利权）人： | 德克萨斯仪器股份有限公司 |
| 主分类号： | H03L7/08 | 分类号： | H03L7/08;H03K3/00 |
| 代理公司： | 北京纪凯知识产权代理有限公司 11245 | 代理人： | 赵志刚 |
| 地址： | 美国德*** | 国省代码： | 暂无信息 |
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| 摘要： | 电路包括时间‑数字转换器(TDC)(102)，以产生输出信号，该输出信号是到TDC(102)的第一输入时钟和到TDC(102)的第二输入时钟之间的时间差的函数。第一延迟线(502)将时间延迟加到第三时钟以产生第一输入时钟。伪随机二进制序列发生器(504)生成伪随机二进制位序列(PRBS)，以改变由第一延迟线加到第三时钟的时间延迟量。 | ||
| 搜索关键词： | 整数 模式 数字 锁相环 摆动 减少 | ||
【主权项】：
暂无信息
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