[发明专利]积和运算器、逻辑运算器件、神经形态器件及积和运算方法在审
| 申请号： | 201980079429.5 | 申请日： | 2019-01-09 |
| 公开（公告）号： | CN113261005A | 公开（公告）日： | 2021-08-13 |
| 发明（设计）人： | 伊藤邦恭;柴田龙雄;寺崎幸夫 | 申请（专利权）人： | TDK株式会社 |
| 主分类号： | G06G7/60 | 分类号： | G06G7/60;G06N3/063 |
| 代理公司： | 北京尚诚知识产权代理有限公司 11322 | 代理人： | 杨琦;黄浩 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
| 权利要求书： | 暂无信息 | 说明书： | 暂无信息 |
| 摘要： | 本发明提供一种积和运算器，其具备：多个积运算部，其将与输入值对应的输入信号乘以权重，生成输出信号，并输出所述输出信号；电流检测部，其在从根据所述输入信号的输入的向所述积运算部的寄生电容的充电引起的第一过渡响应收敛且成为恒定状态的时间到产生根据所述输入信号的输入的来自所述积运算部的寄生电容的放电引起的第二过渡响应前的时间，从所述输入信号以规定的时间延迟检测多个所述积运算部输出的电流，然后，执行以一定时间间隔检测多个所述积运算部输出的电流的电流检测处理；和运算部，其基于所述电流检测部每所述一定时间间隔检测的电流，对与所述输出信号的总和关联的值进行运算。 | ||
| 搜索关键词： | 运算器 逻辑运算 器件 神经 形态 运算 方法 | ||
【主权项】：
暂无信息
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