[发明专利]高集成度的时钟SoC芯片有效
| 申请号： | 202010295051.7 | 申请日： | 2020-04-15 |
| 公开（公告）号： | CN111488311B | 公开（公告）日： | 2022-09-20 |
| 发明（设计）人： | 许文;管晓权;田永和;刘长羽;叶泂涛;陈政 | 申请（专利权）人： | 浙江赛思电子科技有限公司 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 浙江永鼎律师事务所 33233 | 代理人： | 陆永强;张建 |
| 地址： | 314000 浙江省嘉*** | 国省代码： | 浙江;33 |
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| 摘要： | 本发明提供了一种高集成度的时钟SoC芯片，它解决了时钟SoC芯片集成度较低等问题，其包括时钟单元，时钟单元的输入端与SVC静止动态无功补偿器连接，时钟单元的输出端与时钟信号输出连接，时钟单元连接有外部晶振输入，时钟单元通过内部总线与DSP数字信号处理器连接，内部总线上接有LocalBus并行总线、SPI接口单元、UART串口单元、nPPS授时协议单元和PTP协议处理单元，DSP数字信号处理器接有GPIO接口单元和JTAG接口单元，DSP数字信号处理器内设有存储器。本发明具有集成度高、计时精确等优点。 | ||
| 搜索关键词： | 集成度 时钟 soc 芯片 | ||
【主权项】：
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