[发明专利]一种用于加速Deep Q-Network算法的硬件架构及其设计空间探索方法有效
| 申请号： | 202010366873.X | 申请日： | 2020-04-30 |
| 公开（公告）号： | CN111652365B | 公开（公告）日： | 2022-05-17 |
| 发明（设计）人： | 刘冰;凤雷;付平;李喜鹏;卢学翼;吴瑞东;王嘉晨;童启凡;周彦臻;谢宇轩 | 申请（专利权）人： | 哈尔滨工业大学 |
| 主分类号： | G06N3/08 | 分类号： | G06N3/08;G06N3/04;G06N3/063;G06N5/04 |
| 代理公司： | 哈尔滨市阳光惠远知识产权代理有限公司 23211 | 代理人： | 刘景祥 |
| 地址： | 150001 黑龙*** | 国省代码： | 黑龙江;23 |
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| 摘要： | 本发明公开了一种用于加速Deep Q‑Network算法的硬件架构及其设计空间探索方法。硬件架构包括：通用处理器模块负责与外部环境进行交互和实现奖励函数的计算，也负责Deep Q‑Network算法经验池的维护；外部DDR存储器负责Deep Q‑Network算法的经验池的存储；AXI总线接口为通用AXI总线接口结构，负责实现通用处理器与FPGA可编程逻辑模块之间控制信号和数据信号的传递与反馈；Target Q模块负责实现Target Q网络的前向推理计算；Current Q模块负责实现Current Q网络的前向推理和反向传播。本发明在高度优化FPGA硬件架构下，实现Deep Q‑Network算法的实时计算。 | ||
| 搜索关键词： | 一种 用于 加速 deep network 算法 硬件 架构 及其 设计 空间 探索 方法 | ||
【主权项】：
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