[发明专利]一种基于字符分隔值文件转换Verilog代码的方法有效

专利信息
申请号: 202010531916.5 申请日: 2020-06-11
公开(公告)号: CN111814417B 公开(公告)日: 2023-09-26
发明(设计)人: 黄继业;闻勇强;高明裕;何志伟;杨宇翔;林辉品 申请(专利权)人: 杭州电子科技大学
主分类号: G06F30/34 分类号: G06F30/34
代理公司: 浙江永鼎律师事务所 33233 代理人: 陆永强
地址: 310018 浙江*** 国省代码: 浙江;33
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摘要: 发明公开了基于字符分隔值文件转换Verilog代码的方法:S1,读取字符分隔值总文件中的数据,根据总文件内的记录去搜索符合条件的字符分隔值子文件;S2,处理字符分隔值总文件和子文件内的数据,生成端口信号列表和变量定义部分的Verilog代码;S3,给每个字符分隔值子文件分配状态号区间,读取各个子文件内的状态跳转数据,生成状态跳转部分的Verilog代码;S4,读取每个字符分隔值子文件内对应状态所执行的操作,生成各个状态语句执行的Verilog代码。本发明为字符分隔值文件数据转化到硬件描述提供了切实可行的方案,当需要编写的状态机状态很多时,可有效简化状态的插入和删除问题以及子状态机间相互跳转问题,能够降低代码编写的出错率,提高开发的效率。
搜索关键词: 一种 基于 字符 分隔 文件 转换 verilog 代码 方法
【主权项】:
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