[发明专利]支持高效乘累加运算的可编程逻辑单元结构有效
| 申请号： | 202010611874.6 | 申请日： | 2020-06-30 |
| 公开（公告）号： | CN111752529B | 公开（公告）日： | 2021-12-07 |
| 发明（设计）人： | 徐彦峰;范继聪;闫华;陈波寅 | 申请（专利权）人： | 无锡中微亿芯有限公司;中国电子科技集团公司第五十八研究所 |
| 主分类号： | G06F7/509 | 分类号： | G06F7/509 |
| 代理公司： | 无锡华源专利商标事务所(普通合伙) 32228 | 代理人： | 过顾佳;聂启新 |
| 地址： | 214000 江苏省*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了一种支持高效乘累加运算的可编程逻辑单元结构，涉及可编程逻辑技术领域，该可编程逻辑单元结构内部通过硬IP实现一个专用乘法器，通过增加专用的乘法器可以有效提高可编程逻辑单元结构的乘法运算能力，专用乘法器与基本逻辑单元共用数据输入端口和数据输出端口，通过第一两输入选择器进行数据选择，从而无需增加数据输入输出端口，因此可以在不增加FPGA的互连压力的基础上，提高可编程逻辑单元结构的乘累加运算效率，从而提高整个FPGA的窄位宽乘累加运算能力。 | ||
| 搜索关键词： | 支持 高效 累加 运算 可编程 逻辑 单元 结构 | ||
【主权项】：
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