[发明专利]一种基于双端口RAM的数据包排序方法和系统有效
| 申请号： | 202010656298.7 | 申请日： | 2020-07-09 |
| 公开（公告）号： | CN111832048B | 公开（公告）日： | 2022-02-11 |
| 发明（设计）人： | 何骏;武元杰;余军;李鹏展;刘武忠;乔绍虎 | 申请（专利权）人： | 郑州信大捷安信息技术股份有限公司 |
| 主分类号： | G06F21/60 | 分类号： | G06F21/60;G06F21/72 |
| 代理公司： | 郑州德勤知识产权代理有限公司 41128 | 代理人： | 黄红梅 |
| 地址： | 450000 河南省*** | 国省代码： | 河南;41 |
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| 摘要： | 本发明提出了一种基于双端口RAM的数据包排序方法和系统，所述系统包括输入状态机、双端口RAM、寄存器组以及输出状态机；所述双端口RAM分别与所述输入状态机和所述输出状态机进行数据通信连接，所述寄存器组分别与所述输入状态机和所述输出状态机进行数据通信连接，用以实现所述的基于双端口RAM的数据包排序方法。本发明通过输入状态机和寄存器组的配合，能够将乱序的数据包按序存储到双端口RAM，再通过输出状态机和寄存器组的配合，将数据包按序从双端口RAM读出，从而有效解决了算法模块的多个算法核并行运算后导致的输出数据包顺序乱序的问题。 | ||
| 搜索关键词： | 一种 基于 端口 ram 数据包 排序 方法 系统 | ||
【主权项】：
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