[发明专利]一种优化集成电路非平衡时钟网络的方法及系统在审
| 申请号： | 202010752704.X | 申请日： | 2020-07-30 |
| 公开（公告）号： | CN111859836A | 公开（公告）日： | 2020-10-30 |
| 发明（设计）人： | 葛颖峰;徐祎喆;朱勇 | 申请（专利权）人： | 北京百瑞互联技术有限公司 |
| 主分类号： | G06F30/337 | 分类号： | G06F30/337;G06F30/3312;G06F111/08;G06F119/12 |
| 代理公司： | 北京国科程知识产权代理事务所(普通合伙) 11862 | 代理人： | 曹晓斐 |
| 地址： | 100085 北京市海淀区上地信息路2号(北京实创*** | 国省代码： | 北京;11 |
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| 摘要： | 本申请公开了一种优化集成电路非平衡时钟网络的方法及系统，属于集成电路技术领域。该方法包括：获取预分析的时序路径的初始状态空间；判断预分析的时序路径的初始状态空间是否大于预设的状态空间值；若大于预设的状态空间值，则输出预分析的时序路径中各个节点的初始执行系数，否则，随机选择预分析的时序路径中的节点进行n次调整，输出第n次调整后各个节点对应的执行系数，其中n小于等于预设次数，且n次调整后的预分析的时序路径的状态空间大于预设的状态空间值，n为大于0的整数。通过随机选择预分析的时序路径中的节点进行调整，能够达到收敛速度和质量的任意控制，有效缩短设计周期，减少调整的次数。 | ||
| 搜索关键词： | 一种 优化 集成电路 平衡 时钟 网络 方法 系统 | ||
【主权项】：
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