[发明专利]ULTRA-低延迟LTE下行链路帧结构有效
| 申请号： | 202010761144.4 | 申请日： | 2015-09-17 |
| 公开（公告）号： | CN111917530B | 公开（公告）日： | 2021-10-29 |
| 发明（设计）人： | S·帕特尔;W·陈;P·加尔;A·达姆尼亚诺维奇;徐浩;魏永斌;D·P·马拉蒂 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | H04L5/00 | 分类号： | H04L5/00 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 戴开良 |
| 地址： | 美国加*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明涉及ULTRA‑低延迟LTE下行链路帧结构。提供了一种用于管理无线通信系统中的用户设备通信的数据结构。在一些示例中，数据结构可以包括一个或多个资源元素块，其中，在定义下行链路子帧中的传输时间间隔的符号内，下行链路信道的频率带宽被划分成一个或多个资源元素块。此外，数据结构可以包括一个或多个资源元素块中的至少一个资源元素块内的控制区域和数据区域。另外，数据结构可以包括位于控制区域内的针对由下行链路信道服务的用户设备的下行链路资源准许。在另一个方面，提供了一种用于生成示例数据结构的网络实体和方法。 | ||
| 搜索关键词： | ultra 延迟 lte 下行 链路帧 结构 | ||
【主权项】：
暂无信息
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