[发明专利]粗粒度可重构处理器中的计算阵列和可重构处理器有效
| 申请号： | 202011066367.5 | 申请日： | 2020-09-30 |
| 公开（公告）号： | CN112269757B | 公开（公告）日： | 2023-10-27 |
| 发明（设计）人： | 张亚学;欧阳鹏 | 申请（专利权）人： | 北京清微智能科技有限公司 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78;G06F15/80 |
| 代理公司： | 北京索睿邦知识产权代理有限公司 11679 | 代理人： | 李根 |
| 地址： | 100192 北京市海*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明为一种粗粒度可重构处理器中的计算阵列和可重构处理器，计算阵列包括以二维行列排布的多个设定计算单元；设定计算单元包括四个相邻的计算单元，四个相邻的计算单元呈两行两列排布。设定计算单元中的合并逻辑单元分别通过设定低位宽的数据互联线连接设定计算单元中计算单元的输入输出控制单元。合并逻辑单元的输出连接高位宽的数据互联线。高位宽的数据互联线位数是低位宽的数据互联线位数的多倍。合并逻辑单元能够将设定计算单元中多个计算单元的低位宽输入数据合并为高位宽输出数据。合并逻辑单元能够通过高位宽的数据互联线输出高位宽输出数据，使得短路径和长路径计算均可达到比较优化的配置，匹配高精度、大位宽的计算场景。 | ||
| 搜索关键词： | 粒度 可重构 处理器 中的 计算 阵列 | ||
【主权项】：
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