[发明专利]FPGA加速的有色Petri网仿真方法及Verilog HDL代码生成工具有效
| 申请号： | 202011500487.1 | 申请日： | 2020-12-18 |
| 公开（公告）号： | CN112613199B | 公开（公告）日： | 2022-05-24 |
| 发明（设计）人： | 张小军;陈成官;曾庆田;鲁法明;李恒忠;陈达;崔建明;王翀;刘辉;郭华;徐建建 | 申请（专利权）人： | 山东科技大学 |
| 主分类号： | G06F30/22 | 分类号： | G06F30/22;G06F30/34 |
| 代理公司： | 吉林省中玖专利代理有限公司 22219 | 代理人： | 李泉宏 |
| 地址： | 266590 山东*** | 国省代码： | 山东;37 |
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| 摘要： | 本发明公开了一种FPGA加速的有色Petri网仿真方法及Verilog HDL代码生成工具，针对基于通用计算机系统的软件相较于基于FPGA的硬件系统仿真速度较慢，且难以描述Petri网的并发结构；而人工使用Verilog进行有色Petri网的描述会随有色Petri网规模的增加而难以实现的问题，本发明提供了一套标准的FPGA加速的有色Petri网Verilog HDL代码生成工具，仅需要编写Petri网描述文档，通过结构体循环方式自动生成代码，避免了人工编写的困难，将生成的Verilog描述文件经过综合、布局布线生成FPGA配置文件后，能够借助FPGA加速提高仿真的速度。 | ||
| 搜索关键词： | fpga 加速 有色 petri 仿真 方法 verilog hdl 代码 生成 工具 | ||
【主权项】：
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