[发明专利]一种用于LDPC译码器的高效交织器及交织方法有效
| 申请号： | 202110385774.0 | 申请日： | 2021-04-11 |
| 公开（公告）号： | CN113206674B | 公开（公告）日： | 2023-06-30 |
| 发明（设计）人： | 肖泽龙;费志伟;薛文;胡泰洋;邵晓浪;张晋宇;吴礼 | 申请（专利权）人： | 南京理工大学 |
| 主分类号： | H03M13/29 | 分类号： | H03M13/29;H03M13/27 |
| 代理公司： | 南京理工大学专利中心 32203 | 代理人： | 陈鹏 |
| 地址： | 210094 *** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了一种用于LDPC译码器的高效交织器及交织方法，该交织器利用FPGA中的分布式RAM作为主要实现资源，通过读写地址控制和存储结构的设计，完成了传统结构中需要采用Benes网络完成的p个节点换序读出，处理后再原序回写的功能，在满足TDMP的LDPC译码器工作要求的同时，兼顾了资源与吞吐率需求。与传统的交织器相比，本发明的交织器在保证读写效率的前提下大幅降低了资源消耗，提高了FPGA的资源利用率。 | ||
| 搜索关键词： | 一种 用于 ldpc 译码器 高效 交织 方法 | ||
【主权项】：
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