[发明专利]将时钟结构用于组织成多个时钟区域的FPGA的方法和装置在审
| 申请号： | 202110637974.0 | 申请日： | 2021-06-08 |
| 公开（公告）号： | CN113270125A | 公开（公告）日： | 2021-08-17 |
| 发明（设计）人： | 朱璟辉;宋宁;林晓志;王添平;陈建光;蒂瓦卡·乔珀拉;王天心;顾震宇 | 申请（专利权）人： | 广东高云半导体科技股份有限公司 |
| 主分类号： | G11C7/22 | 分类号： | G11C7/22 |
| 代理公司： | 北京安信方达知识产权代理有限公司 11262 | 代理人： | 解婷婷;李丹 |
| 地址： | 510700 广东省广州市黄*** | 国省代码： | 广东;44 |
| 权利要求书： | 暂无信息 | 说明书： | 暂无信息 |
| 摘要： | 本申请涉及将时钟结构用于组织成多个时钟区域的FPGA的方法和装置。FPGA包含一个可配置半导体，该可配置半导体组织成多个时钟区域，其时钟结构用于实现用户定义的逻辑功能。该时钟结构提供一组区域时钟信号，该时钟信号由高质量时钟源产生，用于驱动时钟区域中的逻辑块。另外，一组相邻时钟信号或区域间时钟信号由相邻时钟源产生，用于对两个相邻区域的逻辑块进行时钟驱动。此外，时钟结构提供次级时钟信号，该次级时钟信号由区域时钟信号产生且具有低时钟信号质量，用于以时间敏感度较低的逻辑操作对逻辑块进行时钟驱动。 | ||
| 搜索关键词： | 时钟 结构 用于 组织 成多个 区域 fpga 方法 装置 | ||
【主权项】：
暂无信息
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