[发明专利]一种高效编解码规则实现PLC高速差分背板总线的方法在审
| 申请号： | 202110702941.X | 申请日： | 2021-06-24 |
| 公开（公告）号： | CN113406923A | 公开（公告）日： | 2021-09-17 |
| 发明（设计）人： | 罗宏 | 申请（专利权）人： | 深圳市华茂欧特科技有限公司 |
| 主分类号： | G05B19/05 | 分类号： | G05B19/05 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 518000 广东省深圳市宝安区西乡街*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种高效编解码规则实现PLC高速差分背板总线的方法，包含以下步骤：步骤1、PLC背板总线采用LVDS差分数据线进行数据帧的传输；步骤2、数据帧添加CRC32校验码；步骤3、对数据帧中的数据进行8B/10B编码之后再进行底层数据传输；步骤4、PLC对接收到的数据帧进行CRC32校验，只有在数据校验通过的情况下，数据帧才会被接收，否则数据会被丢弃。本发明采用该技术的高速背板总线，为PLC或者分布式IO提供了扩展高速低延时IO模块的方法，并且可以稳定可靠应用于一些恶劣干扰环境下面。 | ||
| 搜索关键词： | 一种 高效 解码 规则 实现 plc 高速 背板 总线 方法 | ||
【主权项】：
暂无信息
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