[实用新型]全加器有效
| 申请号： | 202120667870.X | 申请日： | 2021-03-31 |
| 公开（公告）号： | CN214412689U | 公开（公告）日： | 2021-10-15 |
| 发明（设计）人： | 不公告发明人 | 申请（专利权）人： | 北京源启先进微电子有限公司 |
| 主分类号： | H03K17/22 | 分类号： | H03K17/22;H03K19/00 |
| 代理公司： | 北京合智同创知识产权代理有限公司 11545 | 代理人： | 李杰 |
| 地址： | 100176 北京市大兴区经济开*** | 国省代码： | 北京;11 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 本实用新型实施例提供一种全加器，包括：第一异或电路、第二异或电路、进位电路；第一异或电路用于接入第一求和信号和第二求和信号，第一异或电路包括两组比较电路，第一组所述比较电路用于在第一求和信号不等于第二求和信号时，将第一异或信号上拉为高电平，第二组所述比较电路在第一求和信号的反向信号不等于第二求和信号时，将第一异或信号下拉为低电平；第二异或电路，用于对第一异或信号以及进位输入信号进行异或计算，输出求和信号；进位电路用于根据第一求和信号和第二求和信号中的一个、进位输入信号以及第一异或信号进行计算，输出进位输出信号。 | ||
| 搜索关键词： | 全加器 | ||
【主权项】：
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