[其他]并行处理计算机无效
| 申请号： | 85109763 | 申请日： | 1985-12-23 |
| 公开（公告）号： | CN85109763A | 公开（公告）日： | 1986-07-16 |
| 发明（设计）人： | 高桥文夫;长冈幸夫;原田岩 | 申请（专利权）人： | 株式会社日立制作所 |
| 主分类号： | G06F15/20 | 分类号： | G06F15/20 |
| 代理公司： | 中国国际贸易促进委员会专利代理部 | 代理人： | 赵越 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 多个操作单元相互连接。操作单元包括一个处理器，一个缓冲存储器，以及一个连接在处理器和缓冲存储器之间的数据传输控制电路，它是用于控制与其它操作单元中缓冲存储器的数据输入-输出。缓冲存储器和数据传输控制电路是由数据总线分别将其相互连接。 | ||
| 搜索关键词： | 并行 处理 计算机 | ||
【主权项】：
1、一并行处理计算机包括；相互连接的多个操作单元，其中所述的操作单元包括一个处理器，一个缓冲存储器和一个连接在处理器和缓冲存储器之间的数据传输控制电路，用于控制与另一个上述的操作单元中的缓冲存储器之间的数据输入-输出。上述的缓冲存储器和上述的数据传输控制电路是分别由数据总线相互连接的。
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